藤岡 与周 | 八戸工業大学工学部システム情報工学科
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概要
関連著者
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藤岡 与周
八戸工業大学工学部システム情報工学科
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藤岡 与周
八戸工業大学システム情報工学科
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苫米地 宣裕
八戸工業大学システム情報工学科教授
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苫米地 宣裕
大学院電子電気・情報工学専攻・教授
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苫米地 宣裕
八戸工業大学大学院
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藤岡 与周
八戸工業大学工学部
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亀山 充隆
東北大学大学院情報科学研究科
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亀山 充隆
東北大学大学院情報科学研究科情報基礎科学専攻
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小玉 成人
八戸工大
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小玉 成人
システム情報工学科・講師
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小玉 成人
八戸工業大学システム情報工学科・講師
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小玉 成人
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栗原 伸夫
八戸工業大学工学部システム情報工学科
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松坂 知行
八戸工業大学工学部システム情報工学科
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山口 広行
八戸工業大学工学部システム情報工学科
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松坂 知行
八戸工業大学
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栗原 伸夫
八戸工業大学
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山口 広行
八戸工業大学システム情報工学科・准教授
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栗原 伸夫〔他〕
八戸工業大学工学部システム情報工学科
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八戸工業大学 工学部
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瀧沢 翔
東北大学大学院情報科学研究科
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八戸工業大学工学部システム情報工学科
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藤岡 与周
東北大学大学院情報科学研究科
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苫米地 宣裕
システム情報工学科教授
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松坂 知行
システム情報工学科・教授
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清野 大樹
八戸工業大学システム情報工学科・教授
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尾崎 康弘
東北女子大学・教授
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尾崎 康弘
八戸工業大学システム工学科教授
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大黒 茂
八戸工業大学システム情報工学科
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植野 義則
東北大学大学院情報科学研究科
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尾崎 康弘
八戸工業大学
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佐々木 崇徳
八戸工業大学大学院工学研究科電気電子工学専攻博士後期課程
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亀山 充隆
東北大学工学部
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樋口 龍雄
東北大学工学部
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伊藤 智也
八戸工業大学システム情報工学科講師
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藤岡 与周
システム情報工学科・助教授
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藤田 成隆
八戸工業大学工学部電子知能システム学科
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関 秀廣
八戸工業大学
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木村 昭穂
八戸工業大学感性デザイン学科・准教授
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木村 昭穂
感性デザイン学科・助教授
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奈良 久
八戸工業大学
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内山 晴夫
システム情報工学科・教授
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佐々木 崇徳
八戸工業大学
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武田 悦矢
八戸工業大学先端研究教育開発センター
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八戸工業大学基礎教育研究センター
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藤田 成隆
八戸工業大学工学部電気電子システム学科
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藤田 成隆
八戸工業大学工学部
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関 秀廣
大学院工学研究科電気電子工学専攻・教授、青森県地域結集型共同研究事業(jst:独立行政法人科学技術振興機構)
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関 秀廣
八戸工業大学工学部電気電子工学科
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須郷 浩行
大学院工学研究科電気電子工学専攻前期課程
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宮崎 秀胤
大学院工学研究科電気電子工学専攻前期課程
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内山 晴夫
八戸工業大学システム情報工学科
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安藤 浩司
八戸工業大学システム情報工学科
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佐々木 崇徳
八戸工業大学先端研究教育開発センター
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藤岡 与周
八戸工業大学電子電気・情報工学専攻
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安藤 浩司
八戸工大
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成田 小二郎
八戸工業大学
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大西 誠
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木村 昭穂
八戸工業大学システム情報工学科
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藤岡 与周
東北大学工学部情報工学科
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内山 晴夫
八戸工業大学
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川本 清
八戸工業大学
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佐々木 了
八戸工業大学工学部システム情報工学科
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藤田 成隆
八戸工業大学
著作論文
- フィールドワークと情報収集に基づいたコンテンツ制作技法を育成する教育の試み
- 3-318 動画コンテンツ作成によるエンジニアリングデザイン能力の育成(口頭発表論文,オーガナイズドセッション「エンジニアリングデザイン」-VII-デザイン科目研究(3))
- 7-103 E-Learningと実習を活用したネットワーク教育((9)e-ラーニング実践-I)
- E-learingと実習を活用した情報ネットワーク技術者教育
- 3-217 八戸工業大学FPD関連次世代型技術者養成ユニットにおける新規事業創出マインドの育成方法((25)高度専門技術者教育・社会人のための大学院工学教育,口頭発表論文)
- 演算器レベル・パケット転送方式に基づく高並列VLSIプロセッサの構成(集積回路とアーキテクチャの協創-プロセッサ,メモリ,システムLSI及び一般-)
- 演算器レベル・パケット転送方式に基づく高並列VLSIプロセッサの構成(オンチップ・ネットワーク,集積回路とアーキテクチャの協創-プロセッサ,メモリ,システムLSI及び一般-)
- チップ内パケット転送に基づく高並列プロセッサの構成
- C-12-3 チップ内細粒度パケット転送に基づく高並列VLSIプロセッサの構成(C-12.集積回路B(ディジタル),一般講演)
- ネットワークを介した双方向力制御におけるパケット転送時間補償
- 動的再構成可能並列VLSIプロセッサの設計と評価
- ネットワークパケット転送時間変動の事例調査
- 電源電圧の動的再構成に基づく低消費電力並列VLSIプロセッサの構成
- ギガビットネットワークを用いた動画像伝送遅延時間の評価
- 複数の奥行き計測が可能な両眼視対応点探索並列ハードウェアアルゴリズム
- D-6-5 半田付ヒータ埋込型基板を用いた動的再構成型多入力積和演算器の3次元実装
- 教育用低価格高安全ロボットシステムの開発
- 文章の構想, 作成および発表能力を育成する教育の試み
- 多入力算術演算器の動的再構成に基づく知能ロボット制御用WSI規模並列プロセッサの構成法
- 大規模論理回路の短期間試作用低コスト多層プリント配線板開発システム
- C-12-35 多入力積和・算術論理演算器の動的再構成に基づくステレオビジョン対応点探索用並列プロセッサの構成
- 知能ロボット制御用再構成可能並列プロセッサの並列プログラミング
- 8-104 ネットワーク技術者資格の学内受験を可能とした資格取得支援の取り組み((06)工学教育の個性化・活性化-I,口頭発表論文)
- 知能ロボット制御用再構成可能並列プロセッサのプログラミング環境
- 数理科学ソフト"Mathematica"を用いた授業方法の研究
- 動的および静的再構成に基づく知能集積システム用並列VLSIプロセッサの構成と評価
- 動的および静的再構成に基づく知能集積システム用 : 並列VLSIプロセッサの構成と評価
- ビットシリアルアーキテクチャに基づくロボット制御用再構成可能VLSIプロセッサの構成
- 知能ロボット制御用再構成可能並列ULSI/WSIプロセッサ
- 知能ロボット制御用再構成可能並列ULSI/WSIプロセッサ
- 演算語長の再構成に基づくビジュアルフィードバック制御用並列プロセッサの構成
- ロボット用 VLSI プロセッサシステム
- ディジタル制御並列VLSIプロセッサの開発
- 再構成可能並列プロセッサと知能ロボット制御への応用
- ビットシリアルアーキテクチャに基づく再構成可能並列VLSIプロセッサの構成と評価
- ビットシリアルアーキテクチャに基づく再構成可能並列VLSIプロセッサと知能集積システムへの応用
- 再構成可能並列VLSIプロセッサと知能ロボット制御への応用
- 知能集積システム用再構成可能並列VLSIプロセッサの構成
- ディジタル制御用再構成可能並列プロセッサの開発
- 冗長マニピュレータ制御用座標変換VLSIプロセッサ
- レジスタトランスファレベルパケット転送に基づく動的再構成VLSIプロセッサアーキテクチャ
- レジスタトランスファレベルパケット転送に基づく動的再構成VLSIプロセッサアーキテクチャ(プロセッサ,DSP,画像処理技術及び一般)
- レジスタトランスファレベルパケット転送に基づく動的再構成VLSIプロセッサアーキテクチャ(プロセッサ,DSP,画像処理技術及び一般)
- レジスタトランスファレベルパケット転送に基づく動的再構成VLSIプロセッサアーキテクチャ(プロセッサ,DSP,画像処理技術及び一般)
- コンフィグレーションメモリサイズの減少を指向したパケット転送に基づく動的再構成VLSIプロセッサの構成 (画像工学)
- コンフィグレーションメモリサイズの減少を指向したパケット転送に基づく動的再構成VLSIプロセッサの構成 (集積回路)
- コンフィグレーションメモリサイズの減少を指向したパケット転送に基づく動的再構成VLSIプロセッサの構成 (信号処理)
- コンフィグレーションメモリサイズの減少を指向したパケット転送に基づく動的再構成VLSIプロセッサの構成 (VLSI設計技術)
- 3-346 情報系学生向けロボット教材の開発((05)教材の開発-IV,口頭発表)