ビットシリアルアーキテクチャに基づくロボット制御用再構成可能VLSIプロセッサの構成
スポンサーリンク
概要
- 論文の詳細を見る
環境の動的変化に高速に応答する知能ロボットシステムの実現には, センサ信号入力から制御出力までの演算遅れ時間減少が重要となる.本論文では, 所望とする入力数のビットシリアル多入力積和演算器を動的に再構成することにより, 演算部に備えられている全加算器のみならず, ローカルメモリや制御部およびチップ内部配線などの利用効率も徹底的に向上できる, 再構成可能VLSIプロセッサの構成を提案している.再構成可能VLSIプロセッサは要素プロセッサ(PE)間通信のオーバヘッドを大幅に減少できる特長を有することから, PEのチップ面積と多入力積和演算時間の積である面積時間積の減少により, プロセッサ全体の演算性能を大幅に向上できる.一例として, O.8μmCMOS設計ルールに基づく性能評価では, ビットパラレルアーキテクチャに基づく再構成可能VLSIプロセッサと比較して面積時間積と演算遅れ時間を最大で約1/3に減少できることを明らかにしている.
- 社団法人電子情報通信学会の論文
- 1998-02-25
著者
関連論文
- FPGA向きヘテロジニアスマルチコアプロセッサ--SIMD形アクセラレータコアとその評価 (集積回路)
- 低消費電力VLSIプロセッサのハイレベルシンセシスと高速解法
- 次世代リアルワールド応用知能システムとメディアプロセッサへの要求
- LEDR/4相2線プロトコルコンバータを用いた非同期FPGAの構成(デバイスアーキテクチャ2)
- フィールドワークと情報収集に基づいたコンテンツ制作技法を育成する教育の試み
- 3-318 動画コンテンツ作成によるエンジニアリングデザイン能力の育成(口頭発表論文,オーガナイズドセッション「エンジニアリングデザイン」-VII-デザイン科目研究(3))
- 7-103 E-Learningと実習を活用したネットワーク教育((9)e-ラーニング実践-I)
- E-learingと実習を活用した情報ネットワーク技術者教育
- 自律的細粒度パワーゲーティングに基づく低消費電力フィールドプログラマブルVLSI(組込みシステムプラットフォーム)
- 遺伝的アルゴリズムを用いたロジックインメモリVLSIプロセッサのハイレベルシンセシス
- システムLSIに輝かしい未来はあるか?
- 自律適応電源電圧制御に基づく低消費電力FPGAの構成 (リコンフィギャラブルシステム)
- 自律適応電源電圧制御に基づく低消費電力FPGAの構成 (コンピュータシステム)
- 非同期ビットシリアルアーキテクチャに基づくフィールドプログラマブルVLSI(ディジタル・情報家電,放送用,ゲーム機用システムLSI,回路技術(一般,超高速・低電力・高機能を目指した新アーキテクチャ))
- マルチメディア応用ヘテロジニアスマルチコアアーキテクチャの評価(組込みシステムプラットフォーム)
- 形状特徴を用いた人物抽出アルゴリズムとそのVLSIアーキテクチャ(ディジタル・情報家電,放送用,ゲーム機用システムLSI,回路技術(一般,超高速・低電力・高機能を目指した新アーキテクチャ))
- データ圧縮に基づく画像処理VLSIアーキテクチャとその応用(システムLSIの応用と要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術及び一般)
- 3次元情報を用いた車両検出アルゴリズムとそのVLSIアーキテクチャ(システムLSIの応用と要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術及び一般)
- C-12-11 細粒度アーキテクチャに基づくフィールドプログラマブルVLSIの開発(C-12.集積回路B(ディジタル),一般講演)
- 相互結合網簡単化を考慮した遺伝的アルゴリズムに基づく電源・しきい値電圧割当(集積回路とアーキテクチャの協創-プロセッサ,メモリ,システムLSI及び一般-)
- ソース結合形論理に基づく多値ドミノ集積回路の構成
- 再帰的計算に基づく3眼ステレオマッチングのVLSIアーキテクチャ(VLSIアーキテクチャ,集積回路とアーキテクチャの協創〜どう繋ぐ?どう使う?マルチコア〜)
- 強誘電体機能パスゲートを用いたマルチコンテクストフィールドプログラマブルVLSIの構成(VLSIアーキテクチャ,集積回路とアーキテクチャの協創〜どう繋ぐ?どう使う?マルチコア〜)
- 3-217 八戸工業大学FPD関連次世代型技術者養成ユニットにおける新規事業創出マインドの育成方法((25)高度専門技術者教育・社会人のための大学院工学教育,口頭発表論文)
- 演算器レベル・パケット転送方式に基づく高並列VLSIプロセッサの構成(集積回路とアーキテクチャの協創-プロセッサ,メモリ,システムLSI及び一般-)
- 演算器レベル・パケット転送方式に基づく高並列VLSIプロセッサの構成(オンチップ・ネットワーク,集積回路とアーキテクチャの協創-プロセッサ,メモリ,システムLSI及び一般-)
- チップ内パケット転送に基づく高並列プロセッサの構成
- C-12-3 チップ内細粒度パケット転送に基づく高並列VLSIプロセッサの構成(C-12.集積回路B(ディジタル),一般講演)
- ネットワークを介した双方向力制御におけるパケット転送時間補償
- 動的再構成可能並列VLSIプロセッサの設計と評価
- ネットワークパケット転送時間変動の事例調査
- 電源電圧の動的再構成に基づく低消費電力並列VLSIプロセッサの構成
- ギガビットネットワークを用いた動画像伝送遅延時間の評価
- 複数の奥行き計測が可能な両眼視対応点探索並列ハードウェアアルゴリズム
- D-6-5 半田付ヒータ埋込型基板を用いた動的再構成型多入力積和演算器の3次元実装
- 教育用低価格高安全ロボットシステムの開発
- 文章の構想, 作成および発表能力を育成する教育の試み
- 多入力算術演算器の動的再構成に基づく知能ロボット制御用WSI規模並列プロセッサの構成法
- 大規模論理回路の短期間試作用低コスト多層プリント配線板開発システム
- C-12-35 多入力積和・算術論理演算器の動的再構成に基づくステレオビジョン対応点探索用並列プロセッサの構成
- 知能ロボット制御用再構成可能並列プロセッサの並列プログラミング
- 強誘電体デバイスを用いたロジックインメモリVLSIの構成(システムLSIのための先進アーキテクチャ論文)
- 強誘電体不揮発性ロジック素子(デバイス/回路動作 : 強誘電体薄膜とデバイス応用)
- 強誘電体デバイスに基づくロジックインメモリVLSIの構成
- 自律適応電源電圧制御に基づく低消費電力FPGAの構成(低消費電力設計,FPGA応用及び一般)
- 自律適応電源電圧制御に基づく低消費電力FPGAの構成(低消費電力設計,FPGA応用及び一般)
- 自律適応電源電圧制御に基づく低消費電力FPGAの構成(低消費電力設計,FPGA応用及び一般)
- FPGA向きヘテロジニアスマルチコアプロセッサ : SIMD形アクセラレータコアとその評価(専用プロセッサ,アクセラレータ,システムLSIアーキテクチャと組込みシステム-プロセッサ,メモリ,システムLSI,画像処理及び関連するソフトウェア)
- 自律的細粒度パワーゲーティングに基づく低消費電力フィールドプログラマブルVLSI(組込みシステムプラットフォーム)
- マルチメディア応用ヘテロジニアスマルチコアアーキテクチャの評価(組込みシステムプラットフォーム)
- 自律的細粒度パワーゲーティングに基づく低消費電力フィールドプログラマブルVLSI(組込みシステムプラットフォーム)
- マルチメディア応用ヘテロジニアスマルチコアアーキテクチャの評価(組込みシステムプラットフォーム)
- データ圧縮に基づく画像処理VLSIアーキテクチャとその応用(システムLSIの応用と要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術及び一般)
- 3次元情報を用いた車両検出アルゴリズムとそのVLSIアーキテクチャ(システムLSIの応用と要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術及び一般)
- データ圧縮に基づく画像処理VLSIアーキテクチャとその応用(システムLSIの応用と要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術及び一般)
- 8-104 ネットワーク技術者資格の学内受験を可能とした資格取得支援の取り組み((06)工学教育の個性化・活性化-I,口頭発表論文)
- ヘテロジニアスマルチコアプロセッサのためのアルゴリズム変換を考慮したアクセラレータセントリックなタスク割り当て(システム設計と高位・論理設計,物理設計及び一般)
- 同期/非同期ハイブリッドアーキテクチャに基づく低消費電力FPGAの構成(デバイスアーキテクチャ)
- ビットシリアルパイプラインアーキテクチャに基づくフィールドプログラマブルVLSIプロセッサの設計(システムLSIの応用とその要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- ビットシリアルパイプラインアーキテクチャに基づくフイールドプログラマブルVLSIプロセッサの設計(システムLSIの応用とその要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- ビットシリアルパイプラインアーキテクチャに基づくフイールドプログラマブルVLSIプロセッサの設計(システムLSIの応用とその要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- ビットシリアルパイプラインアーキテクチャに基づくフイールドプログラマブルVLSIプロセッサの設計(システムLSIの応用とその要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- ビットシリアルパイプラインアーキテクチャに基づくフィールドプログラマブルVLSIプロセッサの設計
- ソース結合形論理に基づく多値ドミノ集積回路の構成
- ソース結合形論理に基づく多値ドミノ集積回路の構成
- 知能ロボット制御用再構成可能並列プロセッサのプログラミング環境
- 多値・二値ハイブリッドコンテクストスイッチング信号を用いたマルチコンテクストFPGAのアーキテクチャ(デジタル・情報家電, 放送用, ゲーム機用システムLSI, 及び一般)
- 双方向同時制御に基づく非同期データ転送方式とそのVLSI実現(集積エレクトロニクス)
- 高安全自動車道路抽出のための動的再構成可能アーキテクチャ(集積回路技術とアーキテクチャ技術の協調・融合へ向けた,プロセッサ,並列処理,システムLSIアーキテクチャ及び一般)
- 高安全自動車道路抽出のための動的再構成可能アーキテクチャ(集積回路技術とアーキテクチャ技術の協調・融合へ向けた,プロセッサ,並列処理,システムLSIアーキテクチャ及び一般)
- 低消費電力電流モード多値集積回路の最適設計
- C-017 GPUを用いた画像処理の並列プログラミング(ハードウェア・アーキテクチャ,一般論文)
- パネル討論「ポストVLIW時代のマイクロプロセッサ像」
- ウィンドウ演算のための最適スケジューリング・メモリアロケーション(VLSIシステム)
- 画像処理プロセッサのための最適メモリアロケーション(集積回路技術とアーキテクチャ技術の協調・融合へ向けた,プロセッサ,並列処理,システムLSIアーキテクチャ及び一般)
- 数理科学ソフト"Mathematica"を用いた授業方法の研究
- 動的および静的再構成に基づく知能集積システム用並列VLSIプロセッサの構成と評価
- 動的および静的再構成に基づく知能集積システム用 : 並列VLSIプロセッサの構成と評価
- ビットシリアルアーキテクチャに基づくロボット制御用再構成可能VLSIプロセッサの構成
- 知能ロボット制御用再構成可能並列ULSI/WSIプロセッサ
- 知能ロボット制御用再構成可能並列ULSI/WSIプロセッサ
- 演算語長の再構成に基づくビジュアルフィードバック制御用並列プロセッサの構成
- ロボット用 VLSI プロセッサシステム
- ディジタル制御並列VLSIプロセッサの開発
- 再構成可能並列プロセッサと知能ロボット制御への応用
- ビットシリアルアーキテクチャに基づく再構成可能並列VLSIプロセッサの構成と評価
- ビットシリアルアーキテクチャに基づく再構成可能並列VLSIプロセッサと知能集積システムへの応用
- 再構成可能並列VLSIプロセッサと知能ロボット制御への応用
- 知能集積システム用再構成可能並列VLSIプロセッサの構成
- ディジタル制御用再構成可能並列プロセッサの開発
- 冗長マニピュレータ制御用座標変換VLSIプロセッサ
- レジスタトランスファレベルパケット転送に基づく動的再構成VLSIプロセッサアーキテクチャ
- レジスタトランスファレベルパケット転送に基づく動的再構成VLSIプロセッサアーキテクチャ(プロセッサ,DSP,画像処理技術及び一般)
- レジスタトランスファレベルパケット転送に基づく動的再構成VLSIプロセッサアーキテクチャ(プロセッサ,DSP,画像処理技術及び一般)
- レジスタトランスファレベルパケット転送に基づく動的再構成VLSIプロセッサアーキテクチャ(プロセッサ,DSP,画像処理技術及び一般)
- コンフィグレーションメモリサイズの減少を指向したパケット転送に基づく動的再構成VLSIプロセッサの構成 (画像工学)
- コンフィグレーションメモリサイズの減少を指向したパケット転送に基づく動的再構成VLSIプロセッサの構成 (集積回路)
- コンフィグレーションメモリサイズの減少を指向したパケット転送に基づく動的再構成VLSIプロセッサの構成 (信号処理)
- コンフィグレーションメモリサイズの減少を指向したパケット転送に基づく動的再構成VLSIプロセッサの構成 (VLSI設計技術)
- 3-346 情報系学生向けロボット教材の開発((05)教材の開発-IV,口頭発表)