ビットシリアルパイプラインアーキテクチャに基づくフイールドプログラマブルVLSIプロセッサの設計(システムLSIの応用とその要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
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概要
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本稿では,FPGAの性能を超える,2次元セルラアレーとビットシリアルパイプラインアーキテクチャに基づくフイールドプログラマブルVLSI(FPVLSI)を提案する.コントロール/データフローグラフ(CDFG)の構造を直接FPVLSIにマッピングする直接アロケーションにより相互結合網が簡単化する.さらに,セル間接続を4近傍のセルに限定し,1ビットのスイッチブロックを用いることにより,FPGAにおいて問題であった配線ボトルネックを解消する.また,ビットシリアルパイプラインアーキテクチャに基づくセルにより,語長に依存しない高稼働率を達成する.本提案のFPVLSIは典型的な構成のFPGAに比べ,13倍の性能を達成した.
- 社団法人電子情報通信学会の論文
- 2003-10-17
著者
-
坂本 修
東北大学大学院 医学系研究科 発生・発達医学講座 小児病態学分野
-
張山 昌論
東北大学大学院情報科学研究科
-
亀山 充隆
東北大学大学院情報科学研究科
-
坂本 修
東北大学大学院情報科学研究科
-
大澤 尚学
東北大学大学院情報科学研究科
-
張山 昌論
東北大学大学院
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