データ圧縮に基づく画像処理VLSIアーキテクチャとその応用(システムLSIの応用と要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術及び一般)
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概要
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並列画像処理プロセッサ実現を高速かつ低消費電力で実現するためには,メモリモジュールとプロセッサ間の並列データ転送のための配線数を減らすことが重要となる.本研究では,差分を用いた画像圧縮法により,性能を低下させず配線数を削減するアーキテクチャを検討する.ステレオビジョンVLSIの例を用いて評価を行ったところ,処理速度一定条件下で配線数を25%削減できた.
- 社団法人電子情報通信学会の論文
- 2007-10-18
著者
-
張山 昌論
東北大学大学院情報科学研究科
-
亀山 充隆
東北大学大学院情報科学研究科
-
小林 康浩
小山工業高等専門学校
-
吉田 恒
東北大学大学院情報科学研究科
-
張山 昌輪
東北大学大学院情報科学研究科
-
張山 昌論
東北大学大学院
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