MIMD演算器アレイ型動的再構成可能アクセラレータを有するヘテロジニアスマルチコアプロセッサのFPGAプラットフォーム(プロセッサ,DSP,画像処理技術及び一般)
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概要
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メディア処理から高性能計算までカバーできるエネルギー効率のよいアーキテクチャとして,CPUとアクセラレータを組み合わせたヘテロジニアスマルチコアアーキテクチャが注目されている.応用に依存して処理の性質,要求仕様などが異なるため,応用に応じて最適なアクセラレータの構成も異なる.そこで,本稿では,再構成可能デバイスであるFPGAを用いてヘテロジニアスマルチコアアーキテクチャのプラットフォームを構築し,応用毎に最適なアーキテクチャを構築することを目的とする.特に,独立制御可能な演算器が2次元アレイ状に接続されたMIMD-2D型アクセラレータを備えるヘテロジニアスマルチコアアーキテクチャのためのFPGAプラットフォームを報告する.
- 2011-10-17
著者
-
張山 昌論
東北大学大学院情報科学研究科
-
亀山 充隆
東北大学大学院情報科学研究科
-
ウィシディスーリヤ ハシタムトゥマラ
東北大学大学院情報科学研究科
-
ウィシディスーリヤ ハシタ
東北大学大学院情報科学研究科
-
張山 昌輪
東北大学大学院情報科学研究科
-
武井 康浩
東北大学大学院情報科学研究科
-
張山 昌論
東北大学大学院
-
ウィシディスーリヤ ハシタ
東北大学大学院
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