ビットシリアル演算セルに基づくフィールドプログラマブルVLSIプロセッサの構成
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概要
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専用プロセッサをフルカスタムよりも安価に実現する方式として,FPGAに基づく方式がある.FPGAでは,汎用性のためにスイッチブロックがクロスバスイッチ構造をとっているため,その面積と遅延が大きくなり,フルカスタムに基づく方式に比べ処理性能が低くなるという問題がある.本稿では,2次元メッシュ網とビットシリアルアーキテクチャによりFPGAの性能を遥かに超えるフィールドプログラマブルVLSI(FPVLSI)を提案する.1bitの演算器と,隣接セル間に接続を限定した1bitのスイッチブロックにより,スイッチブロックの問題を解決した高並列セルアレイを実現する.また,ビットシリアルアーキテクチャに基づく演算セルを効率よく構成するため,シフトレジスタ構造を用いたビットシリアル演算セルを提案する.ビットシリアルアーキテクチャでは処理が1bitずつ順に行われるという規則性に着目することにより,ビットシリアル演算セルをメモリモード,ワンホットカウンタを用いた制御部モード,ルックアップテーブルを用いたALUモードのいずれかのモードで用いることができる.その結果,セルを小面積で実現でき,高並列なセルアレイを構成できる。
- 社団法人電子情報通信学会の論文
- 2002-08-16
著者
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