ソース結合形論理に基づく多値ドミノ集積回路の構成
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概要
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高速性・低電力性を同時に達成できる新しい回路技術の1つとして, ソース結合形論理に基づく多値ドミノ集積回路を提案する.本提案では差動対回路を基本ゲートとしたソース結合形論理を用いることにより, 低電圧振幅時においても高い電流駆動能力を発揮し, 高速動作が可能となる.また, 多値電流信号を用いることで線形加算が結線のみで実現できるため, 回路の素子数やクリティカルパスが減少する.さらに, 電力消費をできるだけ抑えるために, 提案回路にPrecharge-Evaluate論理を活用して, 電源からグランドへの貫通電流が生じない構成にする.一応用例として, 提案方式を用いた2進SD数乗算器を構成し, 同等機能の2値CMOS実現と比べ同一消費電力で1.6倍の高速化が達成されることを明らかにする.
- 社団法人電子情報通信学会の論文
- 2001-10-19
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