BDD表現からの非同期式組合せ回路の構成法
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概要
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本稿では論理関数のBDD表現の変数節点をセレクタ回路に置換することで非同期式2線2相組合せ回路に変換する構成法について述べる.本構成法はにより修正DIモテルにおけるゲートレベルの非同期式組合せ回路に必要な回路量を減らす事が出来る.また本構成法を拡張することで,多値の入出力を扱える非同期式組合せ回路や,回路を共有した多出力の非同期式組合せ回路を構成する事が可能である事を示す.そしてこれらの構成法を用いて設計したゲートレベルの回路とトランジスタレベルの回路を紹介する.
- 社団法人電子情報通信学会の論文
- 1995-04-28
著者
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