非同期式プロセッサTITAC-2の性能評価
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概要
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同期式回路におけるクロックスキューや増大する消費電力の問題を解決する一つの方法として、クロック信号を用いない非同期式回路力ご注目されている。我々は、2線2相式の非同期式回路を高速化する方法について検討し、その有効性を実証するために、32ビット非同期式プロセッサ TITAC-2 (Tokyo Institute of Technology Asynchronous Computer) の論理設計・レイアウトを行なった。TITAC-2は、0.5μmルール、3層メタル配線の C-MOS スタンダードセルで実現され、現在製造中である。本稿では、TITAC-2のアーキテクチャとシミュレーションによる予測性能について述べる。
- 社団法人情報処理学会の論文
- 1997-03-12
著者
-
上野 洋一郎
東京工業大学情報理工学研究科
-
南谷 崇
東京大学先端科学技術研究センター
-
小沢 基一
東京工業大学大学院情報理工学研究科
-
高村 明裕
東京工業大学大学院情報理工学研究科
-
桑子 雅史
東京工業大学 工学部
-
桑子 雅史
東京大学 先端科学技術研究センター
-
小沢 基一
東京大学先端科学技術研究センター
-
高村 明裕
東京工業大学情報理工学研究科
-
上野 洋一郎
東京工業大学大学院情報理工学研究科
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