1 out of 4符号を用いた低消費電力非同期式回路設計(VLSI回路,デバイス技術(高速,低電圧,低消費電力))
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概要
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最大遅延に合わせたクロックを用いる同期式設計は、今後増大すると予測されている局所領域での遅延変動によってパフォーマンスを上げることが難しくなる。これに対処する方法としてビットごとに時間情報を付加する2線2相式非同期設計があるが、従来手法では消費エネルギーが増大してしまうという欠点があった.その欠点を解消するため,本稿では2線2相式設計で用いられている2線式符号よりもトランジスタのスイッチング回数を減らせる1 out of 4符号を用いた消費エネルギーの削減手法について提案し,回路の設計手法を述べ,本手法が有効な回路とそうでない回路を示す.また,1 out of 4符号を用いて設計した回路の評価を行った結果を示す.
- 社団法人電子情報通信学会の論文
- 2006-08-10
著者
-
南谷 崇
キヤノン(株)
-
中村 宏
東京大学先端科学技術研究センター
-
南谷 崇
東京大学先端科学技術研究センター
-
南谷 崇
東京大学 先端科学技術研究センター
-
中村 宏
東京大学
-
今井 雅
東京大学駒場オープンラボトリー
-
南谷 崇
東京大学
-
藤井 智弘
東京大学先端科学技術センター
-
今井 雅
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