オンチップRAM利用による電力性能の最適化と評価(ARC-3: 低電力アーキテクチャ1, 2005年並列/分散/協調処理に関する『武雄』サマー・ワークショップ(SWoPP武雄2005)-研究会・連続同時開催-)
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概要
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近年のプロセッサは消費電力あたりの性能が重要となっている.我々はキャッシュの代替としてオンチップRAMを用い, 主記憶・プロセッサ間のデータ転送の最適化を行うことで電力性能を改善することを提案し, その有効性を確認するために実在のプロセッサSH4を利用して評価を行った.その結果, オンチップRAMを適切に使用することでデータ転送を最適化でき, Energy Delay Product(EDP)を最大で約15.2%削減できることがわかった.また, オンチップRAM・主記憶間でDMA転送がサポートされる場合はEDPを約26.3%削減できることがわかった.
- 一般社団法人情報処理学会の論文
- 2005-08-03
著者
-
佐藤 三久
筑波大学大学院システム情報工学研究科
-
近藤 正章
東京大学先端科学技術研究センター
-
中村 宏
東京大学先端科学技術研究センター
-
高橋 大介
筑波大学大学院システム情報工学研究科
-
朴 泰祐
筑波大学大学院システム情報工学研究科コンピュータサイエンス専攻
-
高橋 大介
筑波大学計算科学研究センター
-
藤田 元信
東京大学先端科学技術研究センター
-
高橋 睦史
筑波大学|現在 株式会社ルネサステクノロジ
-
高橋 睦史
筑波大学大学院システム情報工学研究科
-
朴 泰祐
筑波大学大学院システム情報工学研究科|筑波大学計算科学研究センター
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