PCクラスタにおけるDVS制御による電力性能の最適化(ARC-3: 低電力アーキテクチャ1, 2005年並列/分散/協調処理に関する『武雄』サマー・ワークショップ(SWoPP武雄2005)-研究会・連続同時開催-)
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概要
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近年, 高性能プロセッサにおいても動的に駆動電圧・動作周波数を変更することで消費電力を削減する機構であるDVS(Dynamic Voltage Scaling)を搭載するプロセッサが増えてきている.プログラムの動作特性に応じて周波数を制御することにより, 消費電力の削減が可能である.PCクラスタの並列アプリケーションにおいては, 通信時に周波数を下げるなどDVSの機能を有効に利用することで, 性能を下げることなく低電力化することが期待できる.本稿では, アプリケーションの実行プロファイルと消費電力の動的な観測に基づき, アプリケーション実行時の計算時や通信時などのフェーズ毎に周波数・電圧の最適化制御を行う手法を提案する.いくつかの周波数で実行した結果を元に, フェーズにおける最適な周波数の選択を行う.本稿では, 通信と計算のフェーズに注目し, いくつかの並列プログラムにおいて, 本手法により電力削減の可能性についての評価実験を行った.DVSを実装しているプロセッサを使用したクラスタを構築し, 実験を行った結果, 定格周波数での動作と比べて最大で約30%のED積の改善ができる可能性があることがわかった.
- 社団法人情報処理学会の論文
- 2005-08-03
著者
-
朴 泰祐
筑波大学計算科学研究センター
-
松岡 聡
国立情報学研究所
-
松岡 聡
東京工業大学
-
佐藤 三久
筑波大学大学院システム情報工学研究科
-
高橋 大介
筑波大学電子・情報工学系
-
木村 英明
筑波大学大学院システム情報工学研究科
-
高橋 大介
筑波大学計算科学研究センター
-
堀田 義彦
筑波大学大学院システム情報工学研究科
-
朴 泰祐
筑波大学
-
高橋 大介
筑波大学
-
木村 英明
筑波大学 第三学群 情報学類
-
佐藤 三久
筑波大学
-
堀田 義彦
筑波大学大学院システム情報工学研究科|現在 株式会社ルネサステクノロジ
-
堀田 義彦
筑波大学
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