次世代省電力メモリを用いた並列プログラムの省電力化の評価(ARC-3 : 性能評価およびモデリング,2007年並列/分散/協調処理に関する『旭川』サマー・ワークショップ(SWoPP旭川2007))
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概要
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近年大規模計算機の省電力化の要求の高まるにつれて,CPUだけでなくメモリの消費電力の削減が重要視されつつある.メインメモリとして使用されるDRAMは揮発性メモリであるため,消費電力,特に待機電力が非常に大きい.しかし,スワップを避けるように設計されるHPCでは必要以上にDRAMを搭載しており,その結果多くの場合搭載された全メモリ使われてはいない.そこで,我々はDRAMメモリの搭載容量を削減するためにメインメモリにMRAMとDRAM,スワップ領域にFLASHを配置した低消費電力システムを提案する.本システムではページングによりメモリアクセスを高速なMRAMに集中させメモリアクセスの最適化を行っている.シミュレーションの結果,DRAM搭載容量を削減することで実行時間の増加を1.3倍に抑え,消費エネルギーを1/3に削減できることを示した.
- 社団法人情報処理学会の論文
- 2007-08-01
著者
-
遠藤 敏夫
東京工業大学グローバルCOE
-
松岡 聡
国立情報学研究所
-
松岡 聡
東京工業大学
-
細萱 祐人
東京工業大学
-
遠藤 敏夫
東京工業大学 学術国際情報センター
-
細萱 祐人
東京工業大学:jst Crest
-
遠藤 敏夫
東京工業大学
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