セルコントローラに基づいた非同期制御回路の合成(VLSIの設計/検証/テスト及び一般論理合成及び高位合成)
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概要
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本稿では、セルコントローラに基づいた非同期制御回路を合成する手法を提案する。本手法では、設計制約とリソースライブラリを用いて高位合成が行われたあと得られたデータパス回路の各演算に対して、セルコントローラをマップすることによってデータパス回路を制御する制御回路を合成する。マッピングという性質上、制御回路の面積と合成時間は、データパス回路における演算の数に比例した値ということがわかる。更に、高位合成から得られたデータパス回路の遅延情報を利用して、制御回路の面積を削減する手法を提案する。両方の手法を組み合わせることによって、多数の演算を実行するデータパス回路を制御する制御回路を効率よく合成することが可能となる。
- 社団法人情報処理学会の論文
- 2003-11-27
著者
-
川鍋 昌紀
東京大学大学院情報理工学系研究科システム情報学専攻
-
中村 宏
東京大学先端科学技術研究センター
-
南谷 崇
東京大学先端科学技術研究センター
-
南谷 崇
東京大学 先端科学技術研究センター
-
今井 雅
東京大学先端科学技術研究センター
-
齋藤 寛
会津大学
-
齋藤 寛
東京大学先端科学技術研究センター
-
川鍋 昌紀
東京大学先端科学技術研究センター
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