齋藤 寛 | 会津大学
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概要
関連著者
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齋藤 寛
会津大学
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南谷 崇
東京大学 先端科学技術研究センター
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南谷 崇
東京大学先端科学技術研究センター
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今井 雅
東京大学先端科学技術研究センター
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米田 友洋
国立情報学研究所
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中村 宏
東京大学先端科学技術研究センター
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齋藤 寛
東京大学先端科学技術研究センター
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濱田 尚宏
会津大学コンピュータ理工学研究科 コンピュータシステム学専攻
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齋藤 寛
会津大学コンピュータ理工学部
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川鍋 昌紀
東京大学大学院情報理工学系研究科システム情報学専攻
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齋藤 寛
会津大学コンピュータ理工学部 コンピュータハードウェア学科
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斎藤 寛
会津大学
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米田 友洋
国立情報学研究所アーキテクチャ科学研究系
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川鍋 昌紀
東京大学先端科学技術研究センター
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OZCAN Metehan
東京大学 先端科学技術研究センター
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小暮 千賀明
東京大学先端科学技術センター
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南谷 崇
キヤノン(株)
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南谷 崇
東京大学
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OZCAN Metehan
東京大学先端科学技術研究センター
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小暮 千賀明
東京大学先端科学技術研究センター
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濱田 尚宏
会津大学
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中村 祐一
日本電気(株)
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小西 隆夫
会津大学コンピュータ理工学部 コンピュータハードウェア学科
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飯塚 成
会津大学
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Ozcan Metahan
東京大学先端科学技術研究センター
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飯塚 成
会津大学大学院コンピュータ理工学研究科
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松本 敦
東北大学電気通信研究所
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今井 雅
東京大学 先端科学技術研究センター
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小暮 千賀明
東京大学 先端科学技術研究センター
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齋藤 寛
東京大学 先端科学技術研究センター
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中村 宏
東京大学 先端科学技術研究センター
-
Kim Euiseok
東京大学先端科学技術研究センター
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Sretasereekul Nattha
東京大学先端科学技術研究センター
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今井 雅
東京大学
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志賀 雄城
会津大学コンピュータ理工学研究科コンピュータシステム学専攻
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山口 良一
ルネサスマイクロシステム(株)
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吉永 稔
ルネサスマイクロシステム(株)
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方波見 英基
会津大学
著作論文
- AI-1-9 ディペンダブルNOCへの挑戦(AI-1.デイベンダブルVLSIに向けて,依頼シンポジウム,ソサイエティ企画)
- 束データ方式による非同期式回路の動作合成手法の提案(デザインガアイ2006-VLSI設計の新しい大地を考える研究会)
- 束データ方式による非同期式回路の動作合成手法の提案(動作合成/データパス合成,デザインガイア2006-VLSI設計の新しい大地を考える研究会)
- 同期式仕様記述を用いた非同期式VLSI設計支援CADシステムの構築と評価(VLSIの設計/検証/テスト及び一般論理合成及び高位合成)
- セルコントローラに基づいた非同期制御回路の合成(VLSIの設計/検証/テスト及び一般論理合成及び高位合成)
- 非同期データパス合成における解探索空間の削減(VLSIの設計/検証/テスト及び一般論理合成及び高位合成)
- 同期式仕様記述を用いた非同期式VLSI設計支援CADシステムの構築と評価(VLSIの設計/検証/テスト及び一般 論理合成及び高位合成)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- セルコントローラに基づいた非同期制御回路の合成(VLSIの設計/検証/テスト及び一般 論理合成及び高位合成)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- 非同期データパス合成における解探索空間の削減(VLSIの設計/検証/テスト及び一般 論理合成及び高位合成)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- 同期式仕様記述を用いた非同期式VLSI設計支援CADシステムの構築と評価
- セルコントローラに基づいた非同期制御回路の合成
- 非同期データパス合成における解探索空間の削減
- 非同期回路におけるデータパス遅延情報を用いた制御信号共有化手法
- 束データ方式による非同期式回路を対象とした動作合成とフロアプランの統合 (ディペンダブルコンピューティング)
- 束データ方式による非同期式回路を対象とした動作合成とフロアプランの統合 (VLSI設計技術)
- 束データ方式による非同期式回路を対象とした動作合成とフロアプランの統合
- セルコントローラに基づいた非同期制御回路の合成(VLSIの設計/検証/テスト及び一般 論理合成及び高位合成)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- 非同期データパス合成における解探索空間の削減(VLSIの設計/検証/テスト及び一般 論理合成及び高位合成)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- セルコントローラに基づいた非同期制御回路の合成(VLSIの設計/検証/テスト及び一般 論理合成及び高位合成)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- 非同期データパス合成における解探索空間の削減(VLSIの設計/検証/テスト及び一般 論理合成及び高位合成)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- FPGA実装を想定した束データ方式による非同期式回路のフロアプラン手法の検討
- 束データ方式による非同期式回路の動作合成手法の提案(動作合成/データパス合成,デザインガイア2006-VLSI設計の新しい大地を考える研究会)
- FPGA実装を想定した束データ方式による非同期式回路のフロアプラン手法の検討 (ディペンダブルコンピューティング)
- FPGA実装を想定した束データ方式による非同期式回路のフロアプラン手法の検討 (VLSI設計技術)
- 束データ方式による非同期式回路の動作合成システムについて
- Force-Directed Scheduling アルゴリズムを用いた非同期式データパス回路合成と効率化の検討
- Force-Directed Schedulingアルゴリズムを用いた非同期式データパス回路合成と効率化の検討(論理合成+高位合成)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会)
- Force-Directed Schedulingアルゴリズムを用いた非同期式データパス回路合成と効率化の検討(論理合成+高位合成)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- Force-Directed Schedulingアルゴリズムを用いた非同期式データパス回路合成と効率化の検討(論理合成+高位合成)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- Force-Directed Schedulingアルゴリズムを用いた非同期式データパス回路合成と効率化の検討(論理合成+高位合成)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- 同期式仕様記述を用いた非同期式VLSI設計支援CADシステムの構築と評価(VLSIの設計/検証/テスト及び一般 論理合成及び高位合成)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- 同期式仕様記述を用いた非同期式VLSI設計支援CADシステムの構築と評価(VLSIの設計/検証/テスト及び一般 論理合成及び高位合成)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- FPGAを対象とした束データ方式による非同期式回路の設計(FPGA応用及び一般)
- FPGAを対象とした束データ方式による非同期式回路の設計(FPGA応用及び一般)
- FPGAを対象とした束データ方式による非同期式回路の設計(FPGA応用及び一般)
- 束データ方式による非同期式回路の設計支援システムの構築(最適化技術,システム設計及び一般)
- FPGAを対象としたネットワークオンチップアーキテクチャの設計手法の提案(再構成回路,物理設計及び一般)
- 整数線形計画問題に基づいたネットワークオンチップにおけるフォールトトレランスのためのタスクの多重割り当て手法(微細化対応技術,デザインガイア2011-VLSI設計の新しい大地-)
- 整数線形計画問題に基づいたネットワークオンチップにおけるフォールトトレランスのためのタスクの多重割り当て手法(微細化対応技術,デザインガイア2011-VLSI設計の新しい大地-)
- 整数線形計画問題に基づいたネットワークオンチップにおけるフォールトトレランスのためのタスクの多重割り当て手法
- 整数線形計画問題に基づいたネットワークオンチップにおけるフォールトトレランスのためのタスクの多重割り当て手法
- 束データ方式による非同期式回路を対象としたシミュレーテッドアニーリングとシーケンスペアによるフロアプラン手法
- 束データ方式による非同期式パイプライン回路を対象とした動作合成手法(動作合成(2),デザインガイア2012-VLSI設計の新しい大地-)
- 束データ方式による非同期式回路を対象としたシミュレーテッドアニーリングとシーケンスペアによるフロアプラン手法(物理設計,システム設計及び一般)