FPGA実装を想定した束データ方式による非同期式回路のフロアプラン手法の検討
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概要
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束データ方式による非同期式回路において性能を決める要因は,遅延素子を含む制御回路の遅延である.したがって,実装の対象となる FPGA 上での制御回路の遅延を概算し,入力から出力までの制御回路の遅延の総和が最小となるようフロアプランを行う.
- 一般社団法人情報処理学会の論文
- 2009-11-25
著者
-
南谷 崇
キヤノン(株)
-
南谷 崇
東京大学先端科学技術研究センター
-
南谷 崇
東京大学 先端科学技術研究センター
-
南谷 崇
東京大学
-
齋藤 寛
会津大学
-
米田 友洋
国立情報学研究所
-
濱田 尚宏
会津大学コンピュータ理工学研究科 コンピュータシステム学専攻
-
米田 友洋
国立情報学研究所アーキテクチャ科学研究系
-
濱田 尚宏
会津大学
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