非同期式プロセッサ TITAC-2 の同期インタフェース
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概要
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我々は32ビット非同期式プロセッサ TITAC-2 (Tokyo Institute of Technology Asynchronous Computer 2) の論理設計・レイアウトを行なった。TITAC-2のメモリには、従来の同期式プロセッサで用いられているのと同じものを使用している。クロックを用いない非同期式プロセッサにおいて同期式のデバイスを使用する場合、それらが要求する動作タイミングを保証し、非同期式回路部分とのインターフェースを行なう方法が問題となる。本稿では、TITAC-2における同期/非同期インターフェースの実現方法を説明する。
- 社団法人情報処理学会の論文
- 1997-03-12
著者
-
上野 洋一郎
東京工業大学情報理工学研究科
-
南谷 崇
東京大学先端科学技術研究センター
-
高村 明裕
東京工業大学大学院情報理工学研究科
-
桑子 雅史
東京工業大学 工学部
-
桑子 雅史
東京大学 先端科学技術研究センター
-
高村 明裕
東京工業大学情報理工学研究科
-
上野 洋一郎
東京工業大学大学院情報理工学研究科
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