二相式非同期プロセッサの構成に関する一考察
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概要
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近年のデバイス技術の進歩により次々と高速な半導体が開発され,実験室レベルではスイッチング遅延が数ピコ秒の論理素子が実現されたという報告もある.しかし,半導体の高速化に伴って,遅延全体の中で配線遅延の占める割合が増加してきた.この結果,回路全体にクロックを分配する必要のある同期式回路では素子の高速性を十分に生かすことが困難になりつつある.非常に高速な素子を生かす方法の一つとしてクロック信号の無い非同期式回路を用いる方法があり,非同期式回路を用いてプロセッサを構成することで高速なプロセッサが得られると考えられる.本稿では,Mullerモデルと要求応答モデルに基づく2相式非同期プロセッサの一構成法を示す.
- 社団法人情報処理学会の論文
- 1992-02-24
著者
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