非同期式回路に適した高速化レイアウトの一手法
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概要
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同期式回路では、最大遅延となるパスを算出し、このパスに対して制約を与えてレイアウトを行うことで性能を向上させている。これは、最大遅延となるパスで同期式回路の性能が決定するからである。ところが、非同期式回路の性能は信号伝播遅延の期待値で決定するため、同期式回路と同一のレイアウト方式では性能に関して最適なレイアウトを行うことができない。そこで、新たに非同期式回路に向いたレイアウト手法を考える必要がある。本稿では、非同期式回路をより高速に動作させる為に、レイアウト時に配線に制約を課す手法を提案し、乗算回路に適用した評価結果を示す。
- 社団法人電子情報通信学会の論文
- 1995-03-27
著者
-
高村 明裕
東京工業大学大学院情報理工学研究科
-
今井 雅
東京工業大学 情報理工学研究科
-
藤井 太郎
東京工業大学 情報理工学研究科
-
南谷 崇
東京工業大学 大学院 情報理工学研究科
-
高村 明裕
東京工業大学情報理工学研究科
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