非同期式プロセッサ TITAC-2 のALUの構成
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概要
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素子遅延に対する配線遅延の相対的な増加により、チップ全体にクロック信号を分配する同期式回路設計の限界が指摘されている。その解決策としてクロックを用いない非同期式回路が注目されている。我々は、現在広く使用されている同期式プロセッサと同等の機能を持ち、高速動作することを目標に32ビット非同期式プロセッサ TITAC-2を設計した。本稿ではALUの回路構成の工夫について述べる。
- 社団法人情報処理学会の論文
- 1997-03-12
著者
-
上野 洋一郎
東京工業大学情報理工学研究科
-
今井 雅
東京工業大学 情報理工学研究科
-
藤井 太郎
東京工業大学 情報理工学研究科
-
南谷 崇
東京大学 先端科学技術研究センター
-
池田 吉朗
東京工業大学 情報理工学研究科
-
石田 伯仁
東京工業大学 情報理工学研究科
-
西川 真哉
東京工業大学 情報理工学研究科
-
上野 洋一郎
東京工業大学大学院情報理工学研究科
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