遅延変動を考慮したスタンダードセルライブラリの構築と評価(レイアウト)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
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概要
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本稿では,Sealable Delay Insensitive(SDI)モデルに基づく非同期式VLSI設計において遅延変動に対する標準時のオーバーヘッドを小さくする設計手法を述べる.提案手法ではSDIモデルにおける信号遷移の順序関係を保証するために用いる相対遅延変動率の上限値Kという値をK≈1とするセルライブラリをゲートサイジング等を利用した方法により構築することでオーバーヘッドを小さくする.そして, HSPICE・Design Analyzerを使用して構築したセルライブラリの評価を行なった結果を述べる.
- 社団法人電子情報通信学会の論文
- 2004-11-25
著者
-
南谷 崇
東京大学 先端科学技術研究センター
-
今井 雅
東京大学 先端科学技術研究センター
-
小暮 千賀明
東京大学 先端科学技術研究センター
-
中村 宏
東京大学 先端科学技術研究センター
-
近藤 正章
東京大学 先端科学技術研究センター
-
小暮 千賀明
東京大学先端科学技術センター
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