A Scheduling Method for Asynchronous VLSI System Design
スポンサーリンク
概要
- 論文の詳細を見る
- 社団法人情報処理学会の論文
- 1998-03-17
著者
-
中村 宏
東京大学大学院情報理工学系研究科
-
上野 洋一郎
東京工業大学情報理工学研究科
-
南谷 崇
東京大学先端科学技術研究センター
-
Rafael K.Morizawa
東京工業大学
-
中村 宏
東京大学
-
南谷 崇
東京大学
-
上野 洋一郎
東京工業大学大学院情報理工学研究科
関連論文
- MIPS R3000プロセッサにおける細粒度動的スリープ制御の実装と評価(計算機システム)
- 3.Power Wall問題へのブレークスルーを目指して : リーク電力削減への試み(未来を切り拓く最先端VLSIテクノロジー)
- eagerレプリケーションミドルウェアの並行制御方法(ストレージ 並列分散データベース,データ工学論文)
- 非同期式カスケードALUアーキテクチャ
- 非同期式パイプライン構造の性能評価
- A Scheduling Method for Asynchronous VLSI System Design
- 非同期式カスケードALUプロセッサの評価
- 非同期式カスケードALUアーキテクチャの提案
- 比例遅延変動モデルに基づく非同期式論理完了信号に関する一考察
- 非同期式パイプラインプロセッサの高性能化手法について
- レイアウトデータに基づく非同期式加算回路の性能比較
- 非同期式プロセッサ TITAC-2 の検証とテスト
- 非同期式プロセッサ TITAC-2 のALUの構成
- 非同期式プロセッサ TITAC-2 のキャッシュ構成
- 非同期式パイプラインの動作解析
- 非同期式プロセッサ TITAC-2 の同期インタフェース
- 非同期式プロセッサTITAC-2の性能評価
- 非期式乗算器の設計と試作
- 非同期式マイクロプロセッサTITAC-2のアーキテクチャ
- 非同期式プロセッサTITAC-2の論理設計
- 非同期式プロセッサTITAC-2のアーキテクチャ
- BDD表現からの非同期式組合せ回路の構成法
- 非同期式プロセッサTITACの遅延非依存性
- 並列処理粒度可変プロセッサーの一方式
- 非同期式プロセッサTITACの設計と評価
- 非同期式プロセッサTITACのアーキテクチャと回路構成
- 非同期式論理回路の遷移因果律について
- 二相式非同期プロセッサの構成に関する一考察
- 非同期式プロセッサの性能評価の試み
- 低エネルギーを目的とした大規模リコンフィギャラブルプロセッサアレイSMAの予備評価(リコンフィギャラブルアーキテクチャ,デザインガイア2008-VLSI設計の新しい大地)
- リーク電力削減のためのコンパイラによるスリープ制御の初期検討(コンパイラ技術およびメニーコアアーキテクチャ)
- Rearrangeable NoC:配線遅延を考慮した分散ルータアーキテクチャ(Inventive and Creative Architecture特別セッションIII)
- ヘテロ構成を考慮したWebサーバ用クラスタシステムの性能と電力のモデリング(ARC-10:クラスタ技術,2008年並列/分散/協調処理に関する『佐賀』サマー・ワークショップ(SWoPP佐賀2008))
- CMPの統計的モデリングによる実行時最適化手法(ARC-2:マルチコア1,2008年並列/分散/協調処理に関する『佐賀』サマー・ワークショップ(SWoPP佐賀2008))
- 省電力MIPSプロセッサにおけるOSの試作とシミュレーションによる電力評価(セッション7:資源管理)
- MIPS R3000プロセッサにおける細粒度動的スリープ制御の実装と評価(低消費電力)
- eager レプリケーションミドルウェアの並行制御方法
- MIPS R3000プロセッサにおける細粒度動的スリープ制御の実装と評価
- 高性能計算のための低電力・高密度クラスタMegaProto(HPCハードウェア)
- 高性能計算のための低電力・高密度クラスタMegaProto(クラスタと通信, 分散処理, 「ハイパフォーマンスコンピューティングとアーキテクチャの評価」に関する北海道ワークショップ(HOKKE-2005))
- 高性能計算のための低電力・高密度クラスタ MegaProto
- コア温度情報を用いたOSによる細粒度パワーゲーティング制御方式の設計
- マルチコアCPUの電力消費特性を考慮した仮想CPUスケジューラ
- CMPにおけるオンチップルータの細粒度パワーゲーティングの評価
- 細粒度パワーゲーティングを制御するOSの資源管理方式
- 細粒度パワーゲーティングを制御するOSの資源管理方式
- 細粒度パワーゲーティングを適用した汎用マイクロプロセッサGeyser-1
- 細粒度パワーゲーティングを適用した汎用マイクロプロセッサGeyser-1
- 省電力MIPSプロセッサを実現するFPGAにおけるOSの開発と評価
- NoCのための多電源可変パイプラインルータ
- 共有キャッシュ分割を考慮したCMP向けプリフェッチスロットリング手法
- MIPS R3000プロセッサにおける細粒度動的スリープ制御の実装と評価(低消費電力)
- モデリングに基づくWebサーバ用計算機クラスタの低消費電力化
- マイクロプロセッサ内の演算器に対する適応型パワーゲーティング
- マイクロプロセッサ内の演算器に対する適応型パワーゲーティング
- Pipeline Blocking:走行時パワーゲーティングのための命令実行制御手法
- コンパイラによる細粒度スリープ制御のためのアーキテクチャ支援技術の検討
- 性能制約下における共有資源へのアクセス制御とDVFSを用いたチップマルチプロセッサの省電力化
- 省電力MIPSプロセッサコア評価のための計算機システムのFPGAによる試作
- 性能制約下における共有資源へのアクセス制御とDVFSを用いたチップマルチプロセッサの省電力化
- 省電力MIPSプロセッサコア評価のための計算機システムのFPGAによる試作
- CMPにおけるオンチップルータのランタイムパワーゲーティングの評価
- 性能制約下における共有資源へのアクセス制御とDVFSを用いたチップマルチプロセッサの省電力化
- 性能制約下における共有資源へのアクセス制御とDVFSを用いたチップマルチプロセッサの省電力化
- 細粒度パワーゲーティングを制御するOSの資源管理方式
- 細粒度パワーゲーティングを制御するOSの資源管理方式
- 5L-5 省電力を目的としたOSによる細粒度パワーゲーティング制御方式の研究(組込みOS,学生セッション,アーキテクチャ,情報処理学会創立50周年記念)
- パケット転送経路の偏りに着目した高性能非同期式ネットワークオンチップの検討(プロセッサ設計,デザインガイア2010-VLSI設計の新しい大地-)
- パケット転送経路の偏りに着目した高性能非同期式ネットワークオンチップの検討(プロセッサ設計,デザインガイア2010-VLSI設計の新しい大地-)
- マイクロプロセッサ内の演算器に対する適応型パワーゲーティング
- 細粒度パワーゲーティングを適用した汎用マイクロプロセッサ Geyser-1
- マイクロプロセッサ内の演算器に対する適応型パワーゲーティング
- 省電力MIPSプロセッサコア評価のための計算機システムのFPGAによる試作
- 省電力MIPSプロセッサコア評価のための計算機システムのFPGAによる試作
- 日本のアーキテクチャ研究に対する期待 : 産業界の視点から
- コア温度の変化に適応するOSによる細粒度パワーゲーティング制御方式
- コア温度の変化に適応するOSによる細粒度パワーゲーティング制御方式
- OSにおける細粒度パワーゲーティング向けオブジェクトコードの実行時管理機構の研究
- OSにおける細粒度パワーゲーティング向けオブジェクトコードの実行時管理機構の研究
- OpenCLを用いたパイプライン並列プログラミングAPIの初期検討
- メニーコアプロセッサにおける競合とスケーラビリティを考慮したスレッドスケジューリング
- メニーコアプロセッサにおける競合とスケーラビリティを考慮したスレッドスケジューリング
- メニーコアプロセッサにおける競合とスケーラビリティを考慮したスレッドスケジューリング
- OpenCLを用いたパイプライン並列プログラミングAPIの初期検討
- OpenCLを用いたパイプライン並列プログラミングAPIの初期検討
- メニーコアプロセッサにおける競合とスケーラビリティを考慮したスレッドスケジューリング
- キャッシュデータをマイグレーションするCMPにおけるスレッドマイグレーション(ハードウェア,ネットワーク,クラウド及び一般)
- ***時キャッシュ電源遮断における性能ペナルティ削減手法の実装
- CPU/GPU間データ通信向け先読み機構の検討
- レジスタ・ファイルと実行ユニットにおけるアクティビティ・マイグレーション
- ***時のキャッシュ電源遮断による性能ペナルティとその削減手法(低消費電力技術,集積回路とアーキテクチャの協創〜ノーマリオフコンピューティングによる低消費電力化への挑戦〜)
- NoC型メニーコア設計のための高速キャッシュシミュレーション
- FX10におけるインタコネクト・コントローラの省電力化手法の初期検討
- NoC型メニーコア設計のための高速キャッシュシミュレーション
- FX10におけるインタコネクト・コントローラの省電力化手法の初期検討
- ***時のキャッシュ電源遮断による性能ペナルティとその削減手法
- ALUローテーションによるスーパスカラプロセッサの性能向上
- 周期実行システムにおける中間データに着目した電力制御手法
- キャッシュ電源遮断時の性能ペナルティ削減のための損失データプリフェッチ
- C-006 ユーザーの快適さを考慮した情報機器の動的電源制御(コンピュータシステム技術,C分野:ハードウェア・アーキテクチャ)