省電力MIPSプロセッサを実現するFPGAにおけるOSの開発と評価
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概要
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本研究は, 演算器ごとのパワーゲーティング技術を施した MIPS R3000 ベースの CPU コア Geyser を各ユニットのスリープ頻度を計るパフォーマンスカウンタを付加した FPGA により実現した環境において, 軽量な OS を実装し, 省電力効果の評価を行った. 実装した OS は, マルチタスク管理, 仮想メモリ管理, 省電力機構を備えている. シミュレーション環境と比べ OS 実行時間は, 約 600 倍の高速化を実現し, パワーゲーティングによりスリープした演算器のリーク電力は誤差率約 10% の範囲で推算することが可能であり, 効率のよい OS 開発環境とともに, 実環境に近い状況でプロセッサの性能評価を行うことができた.
- 2009-07-29
著者
-
天野 英晴
慶應義塾大学大学院理工学研究科
-
中村 宏
東京大学大学院情報理工学系研究科
-
宇佐美 公良
芝浦工業大学
-
砂田 徹也
東京農工大学
-
並木 美太郎
東京農工大学
-
近藤 正章
電気通信大学
-
木村 一樹
東京農工大学工学部情報コミュニケーション工学科
-
長井 智英
東京大学情報理工学系研究科システム情報学専攻
-
天野 英晴
慶應義塾大学
-
中村 宏
東京大学
-
宇佐美 公良
芝浦工業大学工学部
-
長井 智英
東京大学大学院情報理工学系研究科
-
木村 一樹
東京農工大学
-
天野 英晴
慶應義塾大学理工学部
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