FPGAによるUPACSサブルーチンの高速化(リコンフィギャラブル応用)

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概要

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• JAXAの開発した計算流体力学(CFD)パッケージUPACSをFPGAを複数用いた安価な計算システムを用いて高速化する研究を行っており、既に精度修正部、時間積分部の実装を行った。本報告では、UPACSの粘性項部の演算パイプラインを実装し、評価をおこなった。複数のVirtex-5上に演算パイプラインを設計することで、従来のFortranコードをIntel Core 2Duo(2.66GHz)を用いたPCで実行した場合と比べて約209倍の実行速度が見込めることが分かった。また、演算パイプライン内の演算器のレイテンシを変えることで、約192倍の実行速度でスライス数の37%削減が見込める。

• 社団法人電子情報通信学会の論文
• 2009-05-07

著者

• 天野 英晴

  慶應義塾大学大学院理工学研究科

• 長名 保範

  成蹊大学理工学部

• 天野 英晴

  慶應義塾大学

• 森下 博和

  慶應義塾大学理工部情報工学科

• 藤田 直行

  宇宙航空研究開発機構研究開発本部

• 横山 隆哲

  慶應義塾大学理工学部

• 天野 英晴

  慶應義塾大学理工学部

• 森下 博和

  慶応義塾大学理工学部情報工学科

• 長名 保範

  成蹊大学理工学部情報科学科

• 藤田 直行

  宇宙航空研究開発機構

• 藤田 直行

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