Network-on-Chipにおけるエラー検出・訂正方式に関する研究(ネットワークオンチップとマルチコア,2009年並列/分散/協調処理に関する『仙台』サマー・ワークショップ(SWoPP仙台2009))
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概要
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本研究ではエラー耐性技術を用いることでエラー率を抑えつつ電圧を落とすNetwork-on-Chip(NoC)の低消費電力化手法を提案,評価する.本提案手法は,DVFSで設定可能な各電圧に対し,動的に最適なエラー耐性技術を選択することで電力最適化を目指す.評価結果から,エラー検出・訂正技術を用いることでソフトエラーによるパケットの再送を最小限に抑えることができ,その結果1フリットを転送するために必要なエネルギーを40%以上,削減できることがわかった.また,フリットの制御情報に高性能なエラー検出・訂正を行うことはエラー率が高い場合にのみ効果が得られることが分かった.
- 2009-07-28
著者
-
鯉渕 道紘
国立情報学研究所
-
天野 英晴
慶應義塾大学大学院理工学研究科
-
小島 悠
慶應義塾大学
-
松谷 宏紀
東京大学大学院情報理工学系研究科
-
天野 英晴
慶應義塾大学
-
天野 英晴
慶應義塾大学理工学部
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