パイプラインステージ統合による省電力・可変パイプラインルータに関する研究
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概要
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チップ内ネットワークはパケットをパイプライン処理するルータを多数用いることで,高スケーラビリティ,高スループットを実現している.本論文では,トラフィック負荷に応じて動作周波数とパイプライン構成を切り替えることが可能な省電力オンチップルータを提案する.各動作周波数におけるパイプラインステージあたりの処理量を大きくするために,低い動作周波数ではパイプライン段数を浅くする.これを,単純なカスケーディングによるパイプラインステージの統合ではなく,各ステージ処理の並列性を最大限に利用する投機実行によって実現する.評価結果より,性能,電力面で最適なパイプライン構成は,1 段から 3 段とアプリケーションごとに大きく異なることが分かった.さらに,パイプライン構成を変更しない既存のルータに DVFS (Dynamic Voltage and Frequency Scaling) を用いた場合に比べ,提案ルータを用いることで消費電力の増加を最大 46%,抑えることができた.
- 一般社団法人情報処理学会の論文
- 2009-09-18
著者
-
鯉渕 道紘
国立情報学研究所
-
天野 英晴
慶應義塾大学大学院理工学研究科
-
松谷 宏紀
東京大学大学院情報理工学系研究科
-
天野 英晴
慶應義塾大学
-
松谷 宏紀
慶應義塾大学理工学部
-
松谷 宏紀
慶應義塾大学:(現)東京大学大学院情報理工学系研究科
-
天野 英晴
慶應義塾大学理工学部
-
枚田 優人
慶應義塾大学大学院理工学研究科
-
枚田 優人
慶應義塾大学理工学部
-
松谷 宏紀
慶應義塾大学
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