同期式回路スケジューリング法に基づいた非同期式回路設計のための依存性グラフ作成法
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概要
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本論文では, 回路で利用可能な演算器数の制約を課した上で, 同期式回路のスケジューリング法をCDFGに適用した結果を仕様として, 極力実行時間の短い非同期式回路を合成するための依存性グラフ作成法を提案する. まず, 本方法では, 演算器の共有による演算の実行順序制約が極力増加しないように, 各演算に演算器を割り当てる. 特に, 仕様に条件分岐が含まれる場合は, その分岐確率も考慮に入れる. 次に, この割当て結果から, 各演算間の実行順序制約とグラフの整合性を考慮しつつ, ハードウェアに直接マッピング可能な依存性グラフを生成する. 実験結果から, 実際のディジタルフィルタの仕様及びランダムに生成された仮想的な仕様のいずれにおいても, 提案法が有効に機能することが明らかになった.
- 1999-02-25
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