CAMを有する超並列SIMD型演算プロセッサによる効果的なマルチメディアデータ処理について(超並列SIMDプロセッサ,先端的コンピュータシステム技術及び一般)
スポンサーリンク
概要
- 論文の詳細を見る
マルチメディア環境の発展で,モバイル機器搭載LSIには,ユーザニーズを満たすための高速処理,仕様の変化に耐えうるプログラマブル性,及び実装に適した小面積,低消費電力が求められる.一般に,マルチメディアアプリケーションは繰り返し演算処理とテーブルルックアップ処理から構成されるが,従来DSP等のLSIアーキテクチャはこれらの処理を効率よく処理することが困難であった.本研究では,2,048個のPE (Processing Element)を有する,超並列SIMD型演算アーキテクチャと,一致検索処理を高速に実現することのできる機能メモリであるCAM (Content Addressable memory)を融合させることで,高速,小面積,低消費電力,かつプログラマブルに様々なアプリケーションを処理することのできるLSIを開発している。JPEGアプリケーションを用いて,既存のDSPと処理性能を比較した結果,最大約87%の処理クロックサイクル数の削減を実現し,単位面積当たりの処理能力を比較したところ,約4.4倍の性能を得ることができた.
- 2007-10-18
著者
-
野田 英行
(株)ルネサステクノロジシステムソリューション統括本部システムコア技術統括部
-
有本 和民
(株)ルネサステクノロジシステムソリューション統括本部システムコア技術統括部
-
有本 和民
株式会社ルネサステクノロジ
-
有本 和民
三菱電機ulsi開発研究所
-
有本 和民
ルネサステクノロジ
-
有本 和民
株式会社ルネサステクノロジ システムコア技術統括部
-
マタウシュ ハンス
広島大学ナノデバイス・バイオ融合科学研究所
-
齊藤 和則
株式会社ルネサステクノロジ
-
小出 哲士
広島大学ナノデバイス・システム研究センター
-
堂坂 勝己
(株)ルネサステクノロジシステムコア技術統括部
-
黒田 泰斗
株式会社ルネサステクノロジ北伊丹事業所
-
黒田 泰斗
株式会社ルネサステクノロジ
-
マタウッシュ ハンス
広島大学ナノデバイス・システム研究センター
-
マタウシュ ハンスユルゲン
広島大学ナノデバイス・システム研究センター
-
有本 和民
(株)ルネサステクノロジ設計開発本部システムコア技術統括部
-
小出 哲士
広島大学ナノデバイス・バイオ融合科学研究所
-
熊木 武志
広島大学ナノデバイス・バイオ融合科学研究所
-
野田 英行
株式会社ルネサステクノロジ
-
堂阪 勝己
(株)ルネサステクノロジ システムコア技術統括部
-
Mattausch H
広島大 ナノデバイス・バイオ融合科研
-
ユルゲン マタウシュハンス
広島大学 ナノデバイス・バイオ融合科学研究所
-
Juergen M
広島大 ナノデバイスシステム研セ
-
マタウシュ ハンス
広島大学ナノデバイス・システム研究センター
-
Mattausch Hans
広島大学大学院先端物質科学研究科 Hisim研究センター
-
田上 正治
広島大学ナノデバイス・バイオ融合科学研究所(RNBS)
-
石崎 雅勝
株式会社ルネサステクノロジシステムソリューション統括本部
-
行天 隆幸
株式会社ルネサステクノロジシステムソリューション統括本部
-
石崎 雅勝
広島大学ナノデバイス・システム研究センター
-
堂阪 勝己
株式会社ルネサステクノロジ
-
小出 哲士
広島大学
-
ハンス ユルゲン
広島大学ナノデバイス・システム研究センター
-
マタウッシュ ハンスユルゲン
広島大学ナノデバイス・システム研究センター
-
マタウシュ ハンス
広島大学大学院先端物質科学研究科
-
熊木 武志
立命館大学大学院理工学研究科
関連論文
- 低消費電力SoCプラットフィームに適し、電圧スケーラビリティ及び加速スクリーニング性を有する、Advanced-DFM RAM(新メモリ技術とシステムLSI)
- 超並列メモリエンベディッドSIMD型プロセッサアーキテクチャ
- 連想メモリベース自動学習LSIアーキテクチャと手書き文字認識への適用
- 画像特徴を考慮したパラメータ自動調整による画像分割アルゴリズム改善
- SoC組込み向け超並列プロセッサMXたよる画像処理・画像認識の実現
- C-12-32 超並列SIMD型演算プロセッサMX-1への暗号化処理の実装(C-12.集積回路,一般セッション)
- SoC組み込み用超並列プロセッサ(MX)のリアルタイム画像処理への応用(スマートパーソナルシステム,一般)
- プログラマブルロジックePLXを用いたネットワークセキュリティ回路の実装評価(システムオンシリコン設計技術並びにこれを活用したVLSI)
- CAMを有する超並列SIMD型演算プロセッサによる効果的なAES暗号化処理(超並列SIMDプロセッサ,先端的コンピュータシステム技術及び一般)
- MOSFETコンパクトモデルと今後の展開 : バルクMOSFETからマルチゲートMOSFETに向けて(プロセス・デバイス・回路シミュレーション及び一般)
- 3値多ポート連想メモリの開発とその応用例
- リングオシレータを用いた製造ばらつきの解析
- CMOS/SIMOX技術を用いた動作電圧範囲の広いSOI-DRAM
- ボディ制御技術を採用した1V 46ns 16Mbit SOI-DRAMの設計技術
- C-12-27 微細CMOS技術におけるSRAMセルの安定性評価(C-12. 集積回路ACD(メモリ・電源・ばらつき),一般セッション)
- ディペンダブルな組込みシステムに適した省電力高性能通信機構(通信とグリッドII)
- マルチマトリックスコア・アーキテクチャによるリアルタイム画像処理SoC(ディジタル・情報家電,放送用,ゲーム機用システムLSI,回路技術(一般,超高速・低電力・高機能を目指した新アーキテクチャ))
- マトリクス構造超並列プロセッサMX-1のプログラム開発手法(超並列SIMDプロセッサ,先端的コンピュータシステム技術及び一般)
- マトリクス構造超並列プロセッサの概要と画像処理への適用検討(スマートパーソナルシステム,一般)
- 90-nm CMOS技術による多段階読出し方式を用いた128-Kbit,16ポートSRAMの設計(メモリ,VLSI回路,デバイス技術(高速,低電圧,低消費電力))
- 90-nm CMOS技術による多段階読出し方式を用いた128-Kbit,16ポートSRAMの設計(メモリ, VLSI回路,デバイス技術(高速,低電圧,低消費電力))
- バンク型多ポートメモリによる並列プロセッサ用キャッシュメモリの設計(新メモリ技術, メモリ応用技術, 一般)
- 高並列プロセッサのためのバンク構成レジスタファイル(回路技術(一般,超高速・低電力・高機能を目指した新アーキテクチャ))
- 非数値演算を効率良く実行する統合型トレースキャッシュの評価(アーキテクチャ一般及びチップマルチプロセッサ)(デザインガイア2003 : VLSI設計の新しい大地を考える研究会)
- 階層型多バンクメモリを用いた多ポートキャッシュの設計
- 低消費データ保持モードを搭載したモバイル用途向け16Mbit混載DRAMコア(新メモリ技術,メモリ応用技術,一般)
- AT-2-4 SoC組込み超並列プロセッサMXの概要とアプリケーション展開(AT-2.リコンフィギュラブルデバイスとCAD技術,パネルセッションチュートリアルセッション,ソサイエティ企画)
- C-12-40 3値CAMセルのプルダウントランジスタの構成に関する検討(C-12.集積回路D(メモリ),一般講演)
- 3Dグラフィックスに適したRead/Write同時動作が可能な0.18um混載DRAMマクロ
- MOSFETモデル評価用テスト回路(2) : 入力電圧の微少変化の増幅
- MOSFETモデル評価用テスト回路(1) : しきい値電圧付近の電流領域の評価
- 連想メモリベース自動学習LSIアーキテクチャと手書き文字認識への適用
- プログラマブルロジックePLXを用いたネットワークセキュリティ回路の実装評価(システムオンシリコン設計技術並びにこれを活用したVLSI)
- プログラマブルロジックePLXの自動マッピングツールの開発とローカルアーキテクチャ検討(リコンフィギャラブルシステム1,デザインガイア2007-VLSI設計の新しい大地を考える研究会)
- SoC埋め込み型プログラマブルロジックePLX向け自動配線ツールの検討(リコンフィギャラブルデバイス,リコンフィギャラブルシステム,一般)
- 画像特徴を考慮したパラメータ自動調整による画像分割アルゴリズム改善
- C-12-76 同期設計手法を用いたメモリに適した内部クロック発生回路
- PCI Expressによる省電力・高信頼・高性能通信リンクのためのコミュニケータチップ: PEACH
- PCI Expressによる省電力・高信頼・高性能通信リンクのためのコミュニケータチップ: PEACH
- 閉そく網を用いたオンチップバンク型多ポートメモリの検討と回路規模評価(VLSI設計技術とCAD)
- オンチップマルチプロセッサ用共有キャッシュの実現方式の検討とその性能面積評価(VLSIシステム)
- 多段結台網を用いた小面積な多バンクメモリの性能評価(システムオンシリコン設計技術並びにこれを活用したVLSI)
- SOIを用いたキャパシタレス・ツイントランジスタRAM(TTRAM)(プロセッサ, DSP, 画像処理技術及び一般)
- SOIを用いたキャパシタレス・ツイントランジスタRAM (TTRAM)(プロセッサ, DSP, 画像処理技術及び一般)
- SOIを用いたキャパシタレス・ツイントランジスタRAM (TTRAM)(プロセッサ, DSP, 画像処理技術及び一般)
- SOIを用いたキャパシタレス・ツイントランジスタRAM (TTRAM)(プロセッサ, DSP, 画像処理技術及び一般)
- 昇圧センスグランド方式を採用した256Mbit DRAM
- 連想メモリベース適応学習LSIの応用とその評価(若手研究会)
- SoC埋め込み型プログラマブルロジックePLXのネットワークセキュリティ処理への応用(スマートパーソナルシステム,一般)
- 3値多ポート連想メモリの開発とその応用例
- リングオシレータを用いた製造ばらつきの解析
- CAMを有する超並列SIMD型演算プロセッサによる効果的なマルチメディアデータ処理について(超並列SIMDプロセッサ,先端的コンピュータシステム技術及び一般)
- C-12-9 超並列SIMDプロセッサによる暗号化(AES)処理の一手法(C-12.集積回路B(ディジタル),一般講演)
- マルチプルCAMマッチとアダプティブテーブル最適化を利用するリアルタイムハフマン符号化アーキテクチャ
- マルチプルCAMマッチとアダプティブテーブル最適化を利用するリアルタイムハフマン符号化アーキテクチャ(ディジタル・情報家電,放送用,ゲーム機用システムLSI,回路技術(一般,超高速・低電力・高機能を目指した新アーキテクチャ))
- CAMによる高速パターンマッチング機能を有する超並列SIMDプロセッサ(システムLSIの応用と要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- CAMによる高速パターンマッチング機能を有する超並列SIMDプロセッサ(システムLSIの応用と要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- CAMによる高速パターンマッチング機能を有する超並列SIMDプロセッサ(システムLSIの応用と要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- CAMによる高速パターンマッチング機能を有する超並列SIMDプロセッサ(システムLSIの応用と要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- マトリクス型超並列プロセッサMX-1の応用事例(超並列SIMDプロセッサ,先端的コンピュータシステム技術及び一般)
- SOIプラットフォーム組み込み用高密度メモリ : Twin transistor RAM(TT-RAM)(新メモリ技術とシステムLSI)
- ワースト条件をなくした低電圧SoC向けオンチップPVT制御システムの提案(システムオンシリコン設計技術並びにこれを活用したVLSI)
- ワースト条件をなくした低電圧SoC向けオンチップPVT制御システムの提案(システムオンシリコン設計技術並びにこれを活用したVLSI)
- 混載DRAM技術を用いてソフトエラー耐性を高めた新規TCAMアーキテクチャ(プロセッサ, DSP, 画像処理技術及び一般)
- 400GOPS 250mW マトリックス型超並列プロセッサの開発 : モバイル向けSoCにも組込み可能な超高速プロセッサIP(VLSI一般(ISSCC2006特集))
- マルチガギガビット時代のDRAM回路設計技術
- マルチガギガビット時代のDRAM回路設計技術
- マルチガギガビット時代のDRAM回路設計技術
- 1.6Gバイト/秒高速1GビットシンクロナスDRAM設計技術 (特集"半導体") -- (メモリ)
- 超低電圧DRAMの技術動向
- 階層型メモリブロックレイアウト方式と分散配置バンク構成を採用した200MHz 1GbitシンクロナスDRAMの設計技術
- 256MビットダイナミックRAM (特集"半導体")
- ギガスケールDRAMのための低電圧回路技術
- 昇圧センスグランド方式によるリフレッシュ特性の改善
- 自動内部電源振幅制御データ保持モードを有する低消費電力DRAM
- サブ50nm時代の切り札SOI : SOIがBulkに勝てる技術はこれだ!(VLSI回路, デバイス技術(高速・低電圧・低消費電力))
- サブ50nm時代の切り札SOI : SOIがBulkに勝てる技術はこれだ!(VLSI回路, デバイス技術(高速・低電圧・低消費電力))
- パイプラインド階層検索とシフト冗長技術を用いた4.5MbダイナミックTCAMの開発(新メモリ技術,メモリ応用技術,一般)
- 混載DRAM技術を用いてソフトエラー耐性を高めた新規TCAMアーキテクチャ(プロセッサ, DSP, 画像処理技術及び一般)
- 混載DRAM技術を用いてソフトエラー耐性を高めた新規TCAMアーキテクチャ(プロセッサ, DSP, 画像処理技術及び一般)
- 混載DRAM技術を用いてソフトエラー耐性を高めた新規TCAMアーキテクチャ(プロセッサ, DSP, 画像処理技術及び一般)
- 相補型プレーナキャパシタを用いた130nm CMOSダイナミック型Ternary CAM(システムLSIの応用とその要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- 相補型プレーナキャパシタを用いた130nm CMOS ダイナミック型Ternary CAM(システムLSIの応用とその要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- 相補型プレーナキャパシタを用いた130nm CMOS ダイナミック型Ternary CAM(システムLSIの応用とその要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- 相補型プレーナキャパシタを用いた130nm CMOS ダイナミック型Ternary CAM(システムLSIの応用とその要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- PCI Express による省電力・高信頼・高性能通信リンクのためのコミュニケータチップ : PEACH
- 新構造メモリ技術とSoCプラットフォーム(新メモリ技術とシステムLSI)
- SoC組み込み用途に適したプログラマブルデバイス技術(リコンフィギャラブルシステム, リコンフィギャラブルシステム, 一般)
- データ保持電流低減に適した256Mb DRAMアレイアーキテクチャ
- データ保持電流低減に適した256Mb DRAMアレイアーキテクチャ
- データ保持電流低減に適した256Mb DRAMアレイアーキテクチャ
- マトリックス型超並列SIMDプロセッサのためのデータ変換バスブリッジの開発(VLSI回路,デバイス技術(高速,低電圧,低消費電力))
- マトリックス型超並列SIMDプロセッサのためのデータ変換バスブリッジの開発(VLSI回路,デバイス技術(高速,低電圧,低消費電力))
- Slightly Boostingを用いた5.3GB/sロジック混載用SDRAMコアの開発
- Slightly Boostingを用いた5.3GB/sロジック混載用SDRAMコアの開発
- Slightly Boostingを用いた5.3GB/sロジック混載用SDRAMコアの開発
- センス同期式書き込み/読出し方式回路を搭載したSRAM I/F混載DRAMコア(MRAM,不揮発メモリ,メモリ,一般)
- DRAM混載システムLSIの現状と今後の動向
- SoC組み込み用超並列プロセッサ(MX)のリアルタイム画像処理への応用
- 4. SoC組込み向け超並列プロセッサMXによる画像処理・画像認識の実現(最先端メディアプロセッサが拓く映像処理)