12.5ns 16Mビット CMOS SRAM
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概要
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0.4μm CMOS技術を用いた16MbCMOS SRAMを開発した。コモンセントロイドレイアウトセンスンプによりアクセス時間を2.4ns高速化した。フレキシブル冗長方式によりアクセス時間の遅れなしに高効率の欠陥救済を実現した。STC付のメモリセルにより、耐ソフトエラーを実現した。チップ面積215mm^2の16MbCMOS SRAMを試作し、アクセス時間12.5nsを得た。
- 社団法人電子情報通信学会の論文
- 1993-11-26
著者
-
池田 修二
日立製作所半導体事業部
-
池田 修二
(株)日立製作所半導体グループ:(現)トレセンティテクノロジーズ
-
石橋 孝一郎
(株)日立製作所中央研究所
-
石橋 孝一郎
ルネサス テクノロジ
-
石橋 孝一郎
日立製作所中央研究所
-
橋本 直孝
日立製作所半導体事業部
-
小宮路 邦広
日立製作所中央研究所
-
朝山 匡一郎
日立製作所
-
森田 貞幸
日立超LSIエンジニアリング
-
青砥 敏郎
日立超LSIエンジニアリング
-
森田 貞幸
(株)ルネサステクノロジ
-
森田 貞幸
日立超lsiエンジニアリング(株)
-
朝山 匡一郎
日立
-
小宮路 邦広
(株)日立製作所、半導体事業部
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