複数IPコア回路におけるスリープブロックの寄生容量を用いたチップ内電源共振雑音低減手法(要素回路技術,低電圧/低消費電力技術,新デバイス・回路とその応用)
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概要
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複数IP回路中にあるスリープブロックの寄生容量を用いた電源共振雑音低減手法を提案した.内部回路そのものが持っている寄生容量を用いて電源雑音を抑えるため、既存のオンチップMOSゲートコンデンサより小面積ながらも効果的に電源雑音をキャンセルすることが可能である.0.18μm CMOSプロセスを用いて試作したテストチップの実測結果から急激な電源が変動する場合とあるブロックをスリープ状態からアクティブ状態に遷移する場合に発生する電源共振雑音を各々43.3%と12.5%低減できることを確認した.このような結果から動的電源制御(DVS)とパワーゲーティングを適用することにあたって速いパワーモード遷移が期待される.
- 2010-08-19
著者
-
池田 誠
東京大学大規模集積システム設計教育研究センター
-
浅田 邦博
東京大学大規模集積システム設計教育研究センター
-
池田 誠
東京大学 大学院 工学系研究科
-
浅田 邦博
東京大学 大学院 工学系研究科
-
名倉 徹
東京大学大規模集積システム設計教育研究センター(VDEC)
-
浅田 邦博
東京大学大学院工学系研究科電子工学専攻
-
浅田 邦博
東京大学大規模集積システム設計教育研究センター(vdec):東京大学大学院工学系研究科電気系工学専攻
-
石橋 孝一郎
(株)ルネサステクノロジ
-
池田 誠
(株)東芝電力・産業システム技術開発センター
-
石橋 孝一郎
(株)日立製作所中央研究所
-
石橋 孝一郎
ルネサスエレクトロニクス
-
金 鎮明
東京大学大学院工学系研究科
-
高田 英裕
三菱電機
-
高田 英裕
ルネサスエレクトロニクス株式会社技術開発本部
-
浅田 邦博
東京大学大学院工学系研究科
-
池田 誠
東京大学大学院工学系研究科
-
金 鎮明
東京大学大学院工学系研究科電気系工学専攻
-
名倉 徹
東京大学大規模集積システム設計教育研究センター
-
高田 英裕
ルネサスエレクトロニクス株式会社
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