セルレイアウトの歩留まり最適化のためのタイミング制約下におけるデコンパクション手法(VLSIの設計/検証/テスト及び一般(デザインガイア))
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概要
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本稿では歩留まり最適化のためのセルレイアウトのデコンパクション手法を提案する.歩留まりを考慮した論理合成やフィジカル合成などにおいては歩留まりを最適化したセルライブラリが必要不可欠であり, 提案手法では元々のセルレイアウトをデコンパクションすることでレイアウトの歩留まりを自動的に最適化する.本手法では, 与えられたタイミング制約の下でセルレイアウトのデコンパクションを行う.タイミング制約の記述には, 与えられる元々のレイアウトの遅延時間からの, デコンパクションによる遅延の増分を近似計算するモデルを提案し, それを用いる.実験結果から遅延時間の近似が十分な精度を実現していることが示され, またセルの性能と歩留まりのトレードオフカーブが得られることが示された.このようなトレードオフカーブから必要な性能のレイアウトを選び出し, 歩留まりを最適化したライブラリとして追加しておくことで, 歩留まりを考慮した最適化手法に必要不可欠なライブラリの構築を行うことができる.
- 社団法人電子情報通信学会の論文
- 2005-11-24
著者
-
池田 誠
東京大学大規模集積システム設計教育研究センター
-
浅田 邦博
東京大学大規模集積システム設計教育研究センター
-
浅田 邦博
東京大学 大学院 工学系研究科
-
飯塚 哲也
東京大学大規模集積システム設計教育研究センター(VDEC)
-
浅田 邦博
東京大学大学院工学系研究科電子工学専攻
-
浅田 邦博
東京大学大規模集積システム設計教育研究センター(vdec):東京大学大学院工学系研究科電気系工学専攻
-
浅田 邦博
東京大学大学院工学系研究科
-
池田 誠
東京大学大学院工学系研究科
-
飯塚 哲也
東京大学大学院工学系研究科:東京大学大規模集積システム設計教育研究センター
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