高速トランジスタ配置を用いたセル内寄生見積もり手法(レイアウト)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
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概要
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最近我々は回路のトポロジ解析に基づいたセル内の寄生見積もり手法を提案した.この手法は簡単なスタンダードセルに対しては有効であることが示されているが,特に複雑なセルに対してはその精度は十分ではない.また簡単なセルに対しても,高い精度を得るためには慎重な校正が必要となっている.これらの問題を解決するため,本論文では非常に高速なトランジスタ配置手法を用いることによって,校正を行うことなく,複雑なセルに対しても正確な寄生見積もりを可能とする手法を提案する.最後に提案手法の例題に対する計算機実験の結果を示し,本手法の妥当性を示す.
- 社団法人電子情報通信学会の論文
- 2004-11-25
著者
-
池田 誠
東京大学大規模集積システム設計教育研究センター
-
浅田 邦博
東京大学大規模集積システム設計教育研究センター
-
浅田 邦博
東京大学大学院工学系研究科電子工学専攻
-
浅田 邦博
東京大学大規模集積システム設計教育研究センター(vdec):東京大学大学院工学系研究科電気系工学専攻
-
吉田 浩章
東京大学大規模集積システム設計教育研究センター
-
吉田 浩章
東京大学大学院工学系研究科
-
DE Kaushik
Zenasis Technologies, Inc.
-
BOPPANA Vamsi
Zenasis Technologies, Inc.
-
浅田 邦博
東京大学大学院工学系研究科
-
池田 誠
東京大学大学院工学系研究科
-
De Kaushik
Zenasis Technologies Inc.
-
Boppana Vamsi
Zenasis Technologies Inc.
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