LSIチップ内のSOI構造トランジスタ素子の熱解析
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概要
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Temperature distributions in SOI transistor devices with trench isolations in LSI chips were calculated using three-dimensional computer simulations. The relations between the maximum temperature increase in transistor devices and the geometric parameters (width and length of aluminum lines on the transistor devices, size of SOI regions, and spacing of two SOI devices) were calculated. We also calculated the effect of placing a heat dissipation layer on the SOI devices. Temperature increases in SOI devices were measured by placing a thermal sensor diode in the SOI region. The calculation results and experimental results agreed well. The calculation results can be used for optimal thermal design of SOI devices in LSI chips.
- 社団法人日本機械学会の論文
- 1996-01-25
著者
-
中里 典生
株式会社日立製作所 機械研究所
-
山口 日出
(株)日立製作所デバイス開発センタプロセス開発部
-
平澤 茂樹
(株)日立製作所 機械研究所
-
中里 典生
(株)日立製作所 機械研究所
-
吉原 和弘
(株)日立製作所デバイス開発センタ
-
永井 謙治
(株)日立製作所デバイス開発センタ
-
大和田 伸郎
(株)日立製作所デバイス開発センタ
-
大和田 伸郎
(株)日立製作所
-
平澤 茂樹
(株)日立製作所
-
平澤 茂樹
神戸大 大学院工学研究科
-
永井 謙治
(株)日立製作所
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