A Low-Power Edge-Triggered and Logic-Embedded Flip-Flop Using Complementary Pass Transistor Circuit(Electronic Circuits)

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概要

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• A new low power edge-triggered and logic embedded flip-flop based on complementary pass transistor circuit is proposed. This flip-flop provides small clock load, short propagation delay, single-phase clock scheme and small layout area. The flip-flop can reduce 35.2% power consumption while improving 24.7% propagation delay in comparison to conventional transmission-gate master-slave flip-flop in a standard 0.35 μm CMOS technology at 1.5 V power supply. In addition, logic functions can be embedded in the flip-flop. In 2-inputs multiplexer and flip-flop circuit, the proposed circuit can reduce 28.0% power consumption and improve 20.3% propagation delay compared to conventional circuit.

• 社団法人電子情報通信学会の論文
• 2004-04-01

著者

• 小柳 光正

  東北大学大学院工学研究科機械知能工学専攻知能システム設計学研究室

• Park Ki-tae

  Halo Lsi Inc.:tohoku University

• KURINO Hiroyuki

  Tohoku University

• KOYANAGI Mitsumasa

  Tohoku University

• MIZUKUSA Tomokatsu

  Tohoku University

• WON Hyo-Sig

  Samsung Electronics Co. Ltd.

• Kurino H

  Dept. Of Bioengineering And Robotics Graduate School Of Engineering Tohoku University

• Kurino H

  Tohoku University

• Kurino Hiroyuki

  Department Of Bioengineering And Robotics Graduate School Of Engineering Tohoku University

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