RSA暗号用高速べき乗剰余演算器の設計
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概要
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代表的な公開鍵暗号であるRSA暗号のための高速動作可能なべき乗剰余演算器を設計した.高速化のため,演算に必要なクロックサイクルの削減効果が高いモンゴメリ乗算と右向きk-ary法を組み合わせたアルゴリズムを考案し,その上でクリティカルパスとなる演算器を分割し,サイクルタイムを削減できる回路構成をとった.本回路の性能評価の結果,0.18μm汎用プロセスで設計した1024ビットのべき乗剰余計算を54.1MHz動作時に3.2msで演算可能であり,回路の高速動作が可能であること,また配置配線の結果,LSIとして実装可能な回路規模であることが確かめられた.
- 社団法人電子情報通信学会の論文
- 2002-11-21
著者
-
永田 真
神戸大学工学部情報知能工学科
-
瀧 和男
エイ・アイ・エル株式会社
-
瀧 和男
(財)新世代コンピュータ技術開発機構
-
瀧 和男
新世代コンピュータ技術開発機構
-
梶原 裕輝
神戸大学大学院自然科学研究科
-
瀧 和男
神戸大 大学院工学系研究科
-
瀧 和男
エイ・アイ・エル
-
永田 真
神戸大学工学部
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