TD-CDMAによる輻輳制御を用いたRFIDシステム向けトランスポンダのIC設計と評価(回路設計)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
スポンサーリンク
概要
- 論文の詳細を見る
非接触での個体識別を行うRFIDシステムに対して,近年大規模流通に適用可能な通信を実現するシステムが求められている.本稿ではCDMAならびにTDMAを併用するTD-CDMAを通信方式の核として、確率的な手法でシステムパラメータを決定することにより,同時に1000以上の個体識別を可能とする輻輳制御方式を提案する.さらにこの輻輳制御方式を実現するトランスポンダ用LSIを試作し,実測結果の報告を行う.
- 社団法人電子情報通信学会の論文
- 2004-11-24
著者
-
永田 真
神戸大学工学部情報知能工学科
-
瀧 和男
神戸大学工学部情報知能工学科
-
瀧 和男
エイ・アイ・エル株式会社
-
瀧 和男
(財)新世代コンピュータ技術開発機構
-
瀧 和男
新世代コンピュータ技術開発機構
-
福水 洋平
(現)東京工業大学統合研究院:神戸大学大学院自然科学研究科
-
大野 修治
神戸大学大学院自然科学研究科
-
福水 洋平
神戸大学大学院自然科学研究科
-
瀧 和男
神戸大 大学院工学系研究科
-
瀧 和男
神戸大学工学部
-
永田 真
神戸大学工学部
関連論文
- マイクロプロセッサにおける基板ノイズの評価と解析(アナログ,アナデジ混載,RF及びセンサインタフェース回路)
- デジタルLSIにおけるオンチップ電源雑音とオフチップ電磁雑音の統合評価(チップ・パッケージ・ボードにおけるパワーインテグリティの設計評価,LSIシステムの実装・モジュール化・インタフェース技術、テスト技術、一般)
- パルス動作型ニューロンモデル用高速大容量シミュレータ
- 実時間三次元CG仮想世界向けネットワーク配信手法
- 3次元CGアニメーションの実時間合成・出力システム
- 低消費電力ディジタル・マッチトフィルタ : プラスチック・ハード・マクロ技術の応用事例
- 低消費電力CMOSセルライブラリの設計と評価 (電子システムの設計技術と設計自動化)
- ソフトコアIPを用いた低消費電力LSI設計 : 低消費電力CMOSセルライブラリの応用と評価
- 低消費電力CMOSセルライブラリの試作
- パストランジスタ論理のためのセル開発とその応用 (機能論理設計, アーキテクチャ設計支援と一般)
- CMOS/パス・トランジスタ混在論理の合成とレイアウト(システムLSIの設計技術と設計自動化)
- 神戸大LISPマシンPROLOGマシン(特集知られざる計算機)
- 並列論理シミュレーション向きタイムワープ機構の効率的な実現手法
- タイムワープ機構の新しい応用 : 並列無格子配線
- タイムワープによる並列論理シミュレータのコンパクトな実現手法
- 大規模デジタル回路におけるグラウンド雑音の解析(信号解析,アルゴリズム,回路設計)
- HDTV対応低消費電力MPEG2 MP@HL動き検出LSIの開発
- バイトコード変換を用いたJava標準API拡張ツール
- C-12-15 HDTV対応低消費電力MPEG2/MP@HL動き検出プロセッサLSIの開発(3) : SIMDデータパスの構成
- 高速低消費電力論理回路方式ASDLのパイプライン化手法とその評価
- プラスチック・ハード・マクロ技術による低消費電力算術演算器
- パストランジスタ論理SPLとその設計事例
- ディジタルAV機器向けGUIソフトウェア開発システム
- CMOS/パス・トランジスタ論理の混在による低消費電力回路の合成
- 共有メモリ型並列計算機におけるキャッシュを意識したオブジェクト内レイアウト法
- 低電圧動作を視野にいれた高速演算用回路方式ASDLの提案
- 低閾値NMOSを用いるパストランジスタ論理回路方式(電子システムの設計技術と設計自動化)
- 大規模デジタル回路におけるグラウンド雑音の解析(信号解析,アルゴリズム,回路設計)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- 大規模デジタル回路におけるグラウンド雑音の解析(信号解析,アルゴリズム,回路設計)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- 大規模デジタル回路におけるグラウンド雑音の解析(信号解析,アルゴリズム,回路設計)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- 実時間三次元アニメーションシステムの並列オブジェクトモデルを用いた実現手法 (並列処理)
- ミックストシグナルSoCのためのオンチップモニタ構築技術(学生・若手研究会)
- オンチップ・マルチチャネルモニタにおける波形取得アルゴリズムの実装と評価(アナログ,アナデジ混載,RF及びセンサインタフェース回路)
- オンチップ・マルチチャネルモニタにおける波形取得アルゴリズムの実装と評価(センサと応用,アナログ,アナデジ混載,RF及びセンサインタフェース回路)
- オンチップマルチチャネル信号モニタによるアナログ回路動作診断
- オンチップマルチチャネル信号モニタによるアナログ回路動作診断(ディジタル・情報家電,放送用,ゲーム機用システムLSI,回路技術(一般,超高速・低電力・高機能を目指した新アーキテクチャ))
- オンチップマルチチャネル信号モニタを用いたチップ内部信号測定システムの構築
- オンチップマルチチャネル信号モニタを用いたチップ内部信号測定システムの構築(イメージセンサのインターフェース回路,アナログ,及び一般)
- マイクロプロセッサにおける基板ノイズの評価と解析(アナログ,アナデジ混載,RF及びセンサインタフェース回路)
- 低消費電力ディジタル・マッチトフィルタ : プラスチック・ハード・マクロ技術の応用事例
- 低消費電力ディジタル・マッチトフィルタ : プラスチック・ハード・マクロ技術の応用事例
- ソフトコアIPを用いた低消費電力LSI設計 : 低消費電力CMOSセルライブラリの応用と評価
- ソフトコアIPを用いた低消費電力LSI設計 : 低消費電力CMOSセルライブラリの応用と評価
- 低消費電力CMOSセルライブラリの試作
- 低消費電力CMOSセルライブラリの試作
- LSIのEMC : チップとボードを統合した電源ノイズの評価・解析手法(学生・若手研究会)
- SC-12-1 アナデジ混載 LSI の基板雑音の測定とシミュレーション
- CMOSデジタル回路の基板雑音発生モデル化手法
- CMOSデジタル回路の基板雑音発生モデル化手法
- CMOSデジタル回路の基板雑音発生モデル化手法
- 電流基板制御方式による基板ノイズ低減及びランダムばらつき抑制効果(プロセッサ, DSP, 画像処理技術及び一般)
- 電流基板制御方式による基板ノイズ低減及びランダムばらつき抑制効果(プロセッサ, DSP, 画像処理技術及び一般)
- 電流基板制御方式による基板ノイズ低減及びランダムばらつき抑制効果(プロセッサ, DSP, 画像処理技術及び一般)
- 高速論理回路方式ASDDL/ASD-CMOSの論理合成手法(システムオンシリコン設計技術並びにこれを活用したVLSI)
- 高速論理回路方式ASDDL/ASD-CMOSの論理合成手法(システムオンシリコン設計技術並びにこれを活用したVLSI)
- 2線2相論理回路方式ASDDL/ASD-CMOSの論理合成手法(VLSIの設計/検証/テスト及び一般論理合成及び高位合成)
- 2線2相論理回路方式ASDDL/ASD-CMOSの論理合成手法(VLSIの設計/検証/テスト及び一般 論理合成及び高位合成)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- 2線2相論理回路方式ASDDL/ASD-CMOSの論理合成手法(VLSIの設計/検証/テスト及び一般 論理合成及び高位合成)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- 2線2相論理回路方式ASDDL/ASD-CMOSの論理合成手法(VLSIの設計/検証/テスト及び一般 論理合成及び高位合成)(デザインガイア2003 -VLSI設計の新しい大地を考える研究会-)
- 2線2相論理回路方式ASDDL/ASD-CMOSの論理合成手法
- デジタルLSIにおけるオンチップ電源雑音とオフチップ電磁雑音の統合評価(チップ・パッケージ・ボードにおけるパワーインテグリティの設計評価,LSIシステムの実装・モジュール化・インタフェース技術、テスト技術、一般)
- 高速低消費電力論理回路方式ASDLのパイプライン化手法とその評価
- 低電圧動作を視野にいれた高速演算用回路方式ASDLの提案
- 低電圧動作を視野にいれた高速演算用回路方式ASDLの提案
- サブ100nmデジタルシグナルインテグリティのためのオンチップモニタ(耐ノイズ・ばらつき設計(1),システムオンシリコン設計技術並びにこれを活用したVLSI)
- サブ100nmデジタルシグナルインテグリティのためのオンチップモニタ(耐ノイズ・ばらつき設計(1),システムオンシリコン設計技術並びにこれを活用したVLSI)
- ダイナミック電源雑音波形を考慮したデジタル信号遅延変動解析(LSIシステムの実装・モジュール化・インタフェース技術,テスト技術,一般)
- ダイナミック電源雑音波形を考慮したデジタル信号遅延変動解析(LSIシステムの実装・モジュール化・インタフェース技術,テスト技術,一般)
- ダイナミック電源雑音波形を考慮したデジタル信号遅延変動解析
- 大規模デジタルLSIのダイナミック電源/グラウンド雑音シミュレーション手法(システムオンシリコン設計技術並びにこれを活用したVLSI)
- 大規模デジタルLSIのダイナミック電源 : グラウンド雑音シミュレーション手法(システムオンシリコン設計技術並びにこれを活用したVLSI)
- ダイナミック電源雑音によるデジタル信号遅延変動の評価
- ダイナミック電源雑音によるデジタル信号遅延変動の評価(デジタル・情報家電, 放送用, ゲーム機用システムLSI, 及び一般)
- B-20-12 TS-CDMAによる超多重RFIDトランスポンダ向け同期回路の検討(B-20.ユビキタス・センサネットワーク,一般講演)
- 超多重RFIDシステムの高位モデル化とバックエンド設計への応用(システムLSIの応用と要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- 超多重RFIDシステムの高位モデル化とバックエンド設計への応用(システムLSIの応用と要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- 超多重RFIDシステムの高位モデル化とバックエンド設計への応用(システムLSIの応用と要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- 超多重RFIDシステムの高位モデル化とバックエンド設計への応用(システムLSIの応用と要素技術,専用プロセッサ,プロセッサ,DSP,画像処理技術,及び一般)
- 超多重RFIDシステムの高位モデル化とバックエンド設計への応用
- TD-CDMAによる輻輳制御を用いたRFIDシステム向けトランスポンダのIC設計と評価(回路設計)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会)
- TD-CDMAによる輻輳制御を用いたRFIDシステム向けトランスポンダのIC設計と評価(回路設計)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- TD-CDMAによる輻輳制御を用いたRFIDシステム向けトランスポンダのIC設計と評価(回路設計)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- TD-CDMAによる輻輳制御を用いたRFIDシステム向けトランスポンダのIC設計と評価(回路設計)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- RSA暗号用高速べき乗剰余演算器の設計
- RSA暗号用高速べき乗剰余演算器の設計
- RSA暗号用高速べき乗剰余演算器の設計
- 非対称な信号遷移を用いた高速論理回路方式(回路設計)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会)
- ミックストシグナル回路における基板結合のオンチップモニタリング(LSIシステムの実装・モジュール化・インタフェース技術,テスト技術,一般)
- ミックストシグナル回路における基板結合のオンチップモニタリング(LSIシステムの実装・モジュール化・インタフェース技術,テスト技術,一般)
- 非対称な信号遷移を用いた高速論理回路方式(回路設計)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- 非対称な信号遷移を用いた高速論理回路方式(回路設計)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- 非対称な信号遷移を用いた高速論理回路方式(回路設計)(VLSIの設計/検証/テスト及び一般)(デザインガイア2004-VLSI設計の新しい大地を考える研究会-)
- 高速ウェル制御回路のダイナミック電源･ウェルノイズの測定および解析方法
- 高速ウェル制御回路のダイナミック電源・ウェルノイズの測定および解析方法(ディジタル・情報家電,放送用,ゲーム機器用システムLSI及び一般)
- デジタル回路における電源/ウェル雑音の高分解能測定技術(システムオンシリコン設計技術並びにこれを活用したVLSI)
- デジタル回路における電源/ウェル雑音の高分解能測定技術(システムオンシリコン設計技術並びにこれを活用したVLSI)
- ミックストシグナル回路における基板結合のオンチップモニタリング
- ミックストシグナルLSIのためのオンチップマルチチャネル信号モニタ(アナログ・デジアナ・センサ, 通信用LSI)
- LTE級携帯端末におけるRFIC受信部の低ノイズ化技術 : 近傍磁界ノイズ計測・対策の立場から(アナログ,アナデジ混載,RF及びセンサインタフェース回路)
- オンチップ環境擾乱に対するアナログIPコアの診断テストベンチの提案(アナログ,アナデジ混載,RF及びセンサインタフェース回路)