大規模デジタル回路におけるグラウンド雑音の解析(信号解析,アルゴリズム,回路設計)
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概要
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大規模CMOS集積論理回路における電源/グラウンド雑音解析を行うためのシミュレーション手法を提案する。シミュレーション・モデルは回路レイアウトとHDLシミュレーションによる活性化率を基に作成した。雑音解析には回路シミュレーションを用いた。大規模デジタル論理回路と基板電位検出回路を搭載した評価チップを0.35μmCMOSで設計・試作するとともに、グラウンド雑音の実測とシミュレーションの比較評価を行い、本手法の有効性を確認した。
- 社団法人情報処理学会の論文
- 2003-11-27
著者
-
永田 真
神戸大学工学部情報知能工学科
-
瀧 和男
神戸大学工学部情報知能工学科
-
杉本 智彦
神戸大学大学院自然科学研究科
-
瀧 和男
エイ・アイ・エル株式会社
-
奥本 健
神戸大学大学院自然科学研究科
-
瀧和 男
神戸大学工学部情報知能工学科
-
奥本 健
松下電器産業(株)半導体社
-
奥本 健
神戸大学工学部
-
瀧 和男
神戸大学工学部
-
永田 真
神戸大学工学部
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