パストランジスタ論理のためのセル開発とその応用 (<特集>機能論理設計, アーキテクチャ設計支援と一般)
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概要
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パストランジスタ論理をスタンダードセル方式でレイアウトするためのセルを提案する. パストランジスタ論理用セルの基本となるセルは, BDDのノード1個または2個, 及び出力インバータ付きノードである. 基本セルを組み合わせて複合セルを設計し, 用途別の複合セルライブラリを簡単に構成することができる. セルはCMOS伝送ゲートに基づいたものとnMOSに基づいたものを設計した. CMOSのセルとの混在にも配慮した. CMOS伝送ゲートに基づくセルで32ビット加算器を設計した結果, CMOSとの比較において面積85%, 動作エネルギー67%, ED積78%と, 効率の良いレイアウトと低消費電力な結果を得ることができた.
- 社団法人情報処理学会の論文
- 1997-12-11
著者
-
瀧 和男
神戸大学工学部情報知能工学科
-
村田 豊
神戸大学大学院自然科学研究科:(現)松下電器産業株式会社
-
北村 清志
エイ・アイ・エル株式会社
-
宇田 研一郎
神戸大学大学院自然科学研究科
-
李 副烈
神戸大学大学院自然科学研究科
-
田中 秀樹
神戸大学大学院自然科学研究科
-
北村 清志
神戸大学大学院自然科学研究科
-
村田 豊
神戸大学工学部情報知能工学科
-
宇田 研一郎
神戸大学自然科学研究科
-
田中 秀樹
千葉大学大学院自然科学研究科
-
滝 和男
神戸大学工学部情報知能工学科
-
瀧 和男
神戸大学工学部
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