低閾値NMOSを用いるパストランジスタ論理回路方式
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概要
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低消費電力特性に優れたパストランジスタ論理SPLに対して低閾値NMOSを適用し,低電源電圧下での動作を目的としたATSPL,高速動作を目的としたMTSPLを提案する. ATSPLは, SPLにおけるパストランジスタ部分と出力インバータのNMOS部分に低閾値NMOSを適用したもの, MTSPLはSPLのパストランジスタ部分にのみ低閾値NMOSを適用したものである.提案したATSPL, MTSPLの評価を32ビット加算器を用いて行った.まず3V動作のSPLに対して, ATSPLは1.8Vで遅延時間が110%, ED積が45%であり,ほぼ同等の動作速度のまま低電圧動作=低消費電力化が達成できていることを確認した.また3V動作のSPLとMTSPLとの比較では,遅延時間が71%, ED積も75%と, MTSPLがほほ同等の消費電力のまま高速動作を実現していることを確認した.
- 社団法人電子情報通信学会の論文
- 1996-12-13
著者
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