CMOS/パス・トランジスタ論理の混在による低消費電力回路の合成
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概要
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パス・トランジスタ論理は,CMOS論理と比較して少ないトランジスタ数で論理回路を実現できる場合が多いが,いかなる回路に対しても有利とは限らない.(N)OR, (N)ANDなどの単純な関数については,CMOS論理が有利となる場合が多い.そこで,論理関数の単純直交分解の結果を表す分解グラフをもとに,CMOS論理をパス・トランジスタ論理と混在させることでトランジスタ数を削減し,低消費電力化を実現する手法を提案する.分解グラフをもとに,単純な関数についてはCMOS論理を適用する一方で,パス・トランジスタ論理で構成する他の部分にはBDD (Binary Decision Diagram)分割を適用し,必要となる中間バッファ数を削減する.本手法による40例のMCNCベンチマーク回路に対する実験の結果,面積最小化指向で合成したCMOS回路や,SPL回路に対して,それぞれ幾何平均で27%,12%の低消費電力化を実現した.
- 社団法人情報処理学会の論文
- 2001-04-15
著者
-
黒木 修隆
神戸大学大学院工学研究科
-
沼 昌宏
神戸大学大学院工学研究科
-
瀧 和男
神戸大学工学部情報知能工学科
-
沼 昌宏
神戸大学 工学部 電気電子工学科
-
山本 啓輔
神戸大学連携創造本部
-
山本 啓輔
神戸大学工学部
-
高田 賢吾
三菱電機株式会社
-
高田 賢吾
神戸大学
-
瀧 和男
神戸大学
-
神野 元彰
神戸大学
-
滝 和男
神戸大学工学部情報知能工学科
-
黒木 修隆
神戸大学 大学院 工学研究科
-
瀧 和男
神戸大学工学部
-
神野 元彰
神戸大学:(現)奈良先端科学技術大学院大学
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