CMOS/パス・トランジスタ混在論理の合成とレイアウト(<特集>システムLSIの設計技術と設計自動化)
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概要
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本稿では,論理関数の単純直交分解の結果を表す分解グラフを利用してCMOS論理とパス・トランジネタ論理を混在させることで,LSIの低消費電力化を実現する合成手法に基づき,多出力回路に対してさらなる論理共有を行い,トランジスタ数を削減する手法を提案する.さらに本手法による合成結果に対して既存ツールによるレイアウトを実現し,実配線を考慮した評価を行うために,CMOS/パス・トランジスタ混在論理用スタンダード・セルライブラリを開発した.このライブラリを用いてベンチマーク回路のレイアウトを行い,実配線を考慮した評価を行った.その結果,CMOS回路,パス・トランジスタ論理回路,および従来手法で合成した回路に対して,16例のベンチマーク回路についての平均で,それぞれ48%,7%,7%の低消費電力化を達成した.
- 社団法人情報処理学会の論文
- 2002-05-15
著者
-
黒木 修隆
神戸大学大学院工学研究科
-
沼 昌宏
神戸大学大学院工学研究科
-
瀧 和男
神戸大学工学部情報知能工学科
-
沼 昌宏
神戸大学 工学部 電気電子工学科
-
山本 啓輔
神戸大学連携創造本部
-
山本 啓輔
神戸大学工学部
-
福岡 一樹
神戸大学大学院自然科学研究科
-
藤田 克也
神戸大学大学院自然科学研究科
-
高田 賢吾
三菱電機株式会社
-
高田 賢吾
神戸大学
-
福冨 弘敦
神戸大学
-
瀧 和男
神戸大学
-
滝 和男
神戸大学工学部情報知能工学科
-
黒木 修隆
神戸大学 大学院 工学研究科
-
瀧 和男
神戸大学工学部
-
福冨 弘敦
神戸大学:(現)奈良先端科学技術大学院大学
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