FPGAの配線構造およびEDAツールによる配線遅延の改善 (マテリアルフォーカス エレナノ 回路そのものが抵抗になるから遅くなる!? 「配線遅延」を解消するマテリアル改質,配線短縮化と光回路実装の可能性)

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概要

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• 2009-03-00

著者

• 飯田 全広

  熊本大学大学院自然科学研究科

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