粒度可変構造を持つ再構成可能論理セル向けテクノロジマッピング手法(リコンフィギャラブルアーキテクチャII,デザインガイア2006-VLSI設計の新しい大地を考える研究会)
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概要
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現在のリコンフィギャラブルロジックデバイスは,論理ブロックの演算粒度によって,粗粒度方式,細粒度方式に大別される.どちらの方式も演算粒度が固定されているため,構造に適したアプリケーションでしか性能を発揮できない.そこで我々は,粒度可変構造を持つ再構成論理セルVGLC(Variable Grain Logic Cell)を提案している.VGLCは,全加算器にメモリを搭載したHC(Hybrid Cell)で構成され,4ビットリップルキャリーアダーや2〜4-LUTと同等の機能を実現できる.本論文では,VGLC向けテクノロジマッピングを行うため,UCLAで開発されたテクノロジマッピングツールであるHeteroMapをベースにVGLC-HeteroMapを開発した.ベンチマーク回路を用いてテクノロジマッピングを行い,4-LUTと比較した場合,クリティカルパス遅延において平均38.6%,コンフィギュレーションビット数において平均47.1%削減できた.
- 社団法人電子情報通信学会の論文
- 2006-11-23
著者
-
飯田 全広
熊本大学大学院自然科学研究科情報電気電子工学専攻
-
末吉 敏則
熊本大学大学院自然科学研究科情報電気電子工学専攻
-
尼崎 太樹
熊本大学大学院自然科学研究科
-
中山 英明
熊本大学大学院自然科学研究科
-
松山 和憲
熊本大学大学院自然科学研究科
-
山口 良一
熊本大学大学院自然科学研究科
-
末吉 敏則
熊本大学大学院自然科学研究科
-
飯田 全広
熊本大学大学院自然科学研究科
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