部分再構成によるソフトコアプロセッサの故障回復手法(ディペンダブル設計,FPGA応用及び一般)
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概要
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SRAM型FPGA (Field Programmable Gate Array)は,再構成可能という特徴をもつ反面,ソフトエラーの影響により誤動作を引き起こすおそれがある.本論文では,TMR (Triple Modular Redundancy)と部分再構成を用いたソフトコアプロセッサの故障緩和・回復手法を検討した.特に,順序回路の部分再構成では内部状態が初期化されるため,冗長回路と内部状態を一致させることを目的として内部状態同期手法の提案を行った.また,ローカルメモリの高信頼化として,ECC (Error Correcting Code)の実装を行った.その結果,ベースシステムと比較して4.315倍の回路規模となったが,6μsで故障状態からの復旧を可能とした.
- 2010-01-19
著者
-
末吉 敏則
熊本大学大学院自然科学研究科情報電気電子工学専攻
-
田上 士郎
熊本大学大学院自然科学研究科
-
尼崎 太樹
熊本大学大学院自然科学研究科
-
久我 守弘
熊本大学大学院自然科学研究科
-
尼崎 太樹
熊本大学大学院自然科学研究科情報電気電子工学専攻
-
一ノ宮 佳裕
熊本大学大学院自然科学研究科
-
末吉 敏則
熊本大学大学院自然科学研究科
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