粒度可変論理セルのコネクションブロック構造と多入力論理実装手法の一検討(リコンフィギャラブルシステム1,デザインガイア2007-VLSI設計の新しい大地を考える研究会)
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概要
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粒度可変論理セルVGLC(Variable Grain Logic Cell)はアプリケーション中の演算にあわせて粒度を可変にできるアーキテクチャ構成をとっている.VGLCは2入力から4入力までの任意の論理関数を実現できるという特徴をもつ.ところが,VGLCの回路構成に着目した場合,4入力以下の任意の論理関数だけでなく,5入力以上の一部の論理関数を実現できるものが存在する.そのような特殊な場合のマッピングを考慮するためには,マッピング対象の回路の論理関数を考慮したブーリアンマッチングを行う必要がある.本稿では,VGLCを用いて多入力論理を実装する方法について述べ,それらをテクノロジマッピングツールに組込み,面積,遅延評価を行った.その結果,2から4入力までの任意の論理関数だけでマッピングを行った場合と比較して,使用VGLC数が最大58.9%,クリティカルパス遅延が最大25.9%削減した.
- 2007-11-13
著者
-
飯田 全広
熊本大学大学院自然科学研究科情報電気電子工学専攻
-
末吉 敏則
熊本大学大学院自然科学研究科情報電気電子工学専攻
-
尼崎 太樹
熊本大学大学院自然科学研究科
-
佐藤 嘉晃
熊本大学大学院自然科学研究科
-
三浦 大
熊本大学大学院自然科学研究科
-
松山 和憲
熊本大学大学院自然科学研究科
-
山口 良一
熊本大学大学院自然科学研究科
-
古賀 正紘
熊本大学大学院自然科学研究科
-
井上 万輝
熊本大学大学院自然科学研究科
-
末吉 敏則
熊本大学大学院自然科学研究科
-
飯田 全広
熊本大学大学院自然科学研究科
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