スモールワールドネットワーク化配線構造によるFPGAの消費電力削減(リコンフィギャラブルアーキテクチャ)
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概要
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プロセス技術の進歩に伴いデバイスの微細化が進み,高集積度のFPGAが登場したことでFPGAの利用が広がっている.しかし,FPGAは低消費電力高さが大きな課題となっている.そこで,我々が提案しているスモールワールドネットワーク配線構造の持つショートカット配線に,スイッチングアクティビティの高いネットに割り当てる配線手法を用い,ダイナミックパワー削減を図る.その結果,従来のFPGA配線構造に比べ提案配線構造では消費電力を約8%削減できることがわかった.また,クリティカルパス遅延においては約4%改悪する結果となった.
- 2009-05-07
著者
-
飯田 全広
熊本大学大学院自然科学研究科情報電気電子工学専攻
-
末吉 敏則
熊本大学大学院自然科学研究科情報電気電子工学専攻
-
尼崎 太樹
熊本大学大学院自然科学研究科
-
西田 翔一
熊本大学大学院自然科学研究科
-
西岡 勇蔵
日立オムロンターミナルソリューションズ株式会社旭事業所
-
末吉 敏則
熊本大学大学院自然科学研究科
-
飯田 全広
熊本大学大学院自然科学研究科
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