配線性を利用する低消費電力指向のクラスタリング及び配置手法(デバイスアーキテクチャ1)
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概要
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FPGA(Field Programmable Gate Array)は専用回路であるASIC(Application Specific Integrated Circuit)に比べ消費電力が高いという問題がある.FPGAでは配線によって多くの電力が消費されており,配線での消費電力の削減が全体の消費電力の削減において重要となる.そこで,本稿ではEDA(Electronic Design Automation)レベルでの消費電力の改善手法として,配線性を考慮したクラスタリング及び配置手法について提案する.本稿ではクラスタの平均接続クラスタ数に着目する.接続するクラスタ数が少なくなると,配置の際に近くに配置をすることが可能となり,必要な配線リソースが少なくなる.そのため,配線を使用する際の競合が少なくなり,配線性が向上する.クラスタリングではクラスタが接続するクラスタ数を少なくし,配置ではクラスタ間の配線が多いクラスタを近くに配置した.結果として,従来手法に比べて平均13%,最大44%の消費電力を削減することができた.
- 2009-09-10
著者
-
末吉 敏則
熊本大学大学院自然科学研究科情報電気電子工学専攻
-
今泉 真哉
熊本大学自然科学研究科
-
飯田 全広
熊本大学自然科学研究科
-
末吉 敏則
熊本大学自然科学研究科
-
飯田 全広
熊本大学大学院自然科学研究科
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