スモールワールドネットワーク化配線構造の詳細遅延評価(リコンフィギャラブルデバイス,リコンフィギャラブルシステム,一般)
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概要
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FPGA(Field Programmable Gate Array)製造プロセスの微細化が急速に進んでいる.しかし,ディープサブミクロンプロセスでは,FPGA内に大量に用意されている配線の遅延が増加する.そのため,配線遅延が総遅延の大半を占めるという問題が発生している.この問題を解決するため,我々はスモールワールドネットワークというグラフ理論をFPGA配線構造に適用した新しい配線構造を提案している.この提案配線構造は,従来の配線構造に対して,ショートカットの役割を果たす配線をランダムに少量追加することで,配線遅延の削減を行う.本論文では,配置配線ツールであるVPR(Versatile Place and Route)を提案配線構造に対応させたツールを用いて,提案配線構造の評価を行う.その結果,実際のクリティカルパス遅延と予測した値が大きく異なる回路に対して,提案配線構造はクリティカルパス遅延を削減し,非常に高い改善率を示した.
- 2007-05-10
著者
-
飯田 全広
熊本大学大学院自然科学研究科情報電気電子工学専攻
-
末吉 敏則
熊本大学大学院自然科学研究科情報電気電子工学専攻
-
西岡 勇蔵
日立オムロンターミナルソリューションズ株式会社旭事業所
-
西岡 勇蔵
熊本大学大学院自然科学研究科
-
月足 彌
株式会社ルネサステクノロジ
-
末吉 敏則
熊本大学大学院自然科学研究科
-
飯田 全広
熊本大学大学院自然科学研究科
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