粒度可論理セルにおける入力粒度最適化の一検討(リコンフィギャラブルアーキテクチャ)
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概要
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リコンフィギャラブルIPをSoC設計に用いることで,専用回路であるASICとは異なりチップ単位での柔軟性をもたせることができる.しかしながら,現在のFPGAアーキテクチャをそのままIPコアとして用いただけではその性能ギャップは明らかである.そこで我々は,リコンフィギャラブルIP (Intellectual Property)として粒度可変論理セルVGLC (Variable Grain Logic Cell)アーキテクチャを提案している.本論文ではテクノロジマッピングにおいて,VGLCを構成するBLEの粒度最適化に関しての検討を行った.その結果,面積に関してはBLEの粒度は3入力が,論理段数に関しては粒度が5入力であることがわかった.
- 2008-09-18
著者
-
飯田 全広
熊本大学大学院自然科学研究科情報電気電子工学専攻
-
末吉 敏則
熊本大学大学院自然科学研究科情報電気電子工学専攻
-
尼崎 太樹
熊本大学大学院自然科学研究科
-
三浦 大
熊本大学大学院自然科学研究科
-
古賀 正紘
熊本大学大学院自然科学研究科
-
末吉 敏則
熊本大学大学院自然科学研究科
-
飯田 全広
熊本大学大学院自然科学研究科
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