構成メモリを削減したアダプティブLUTアーキテクチャの提案(リコンフィギャラブルアーキテクチャ)
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概要
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現在,多くのFPGA (Field Programmable Gate Array)の論部セルにはLUT (Look-Up Table)が用いられており,任意の論理が実装可能である.しかし,回路を実装する際に全ての論理が均等に使用されるわけではなく,限られた一部の論理しか使用されていないことが事前調査により分かっている.本稿では,6入力,5入力の出現確率の高い一部の論理と4入力全ての論理を実装可能なA^2LUT(Abridged Adaptive LUT)を提案する.A^2LUTは従来のLUTより少ない構成メモリ数で論理を実装し,全体の面積の削減を行う.面積は4-LUTと比較すると平均14.45%悪化しているが,5-LUTと比較して平均9.09%改善,6-LUTと比較すると平均12.87%改善することがわかった.
- 2011-05-05
著者
-
末吉 敏則
熊本大学大学院自然科学研究科情報電気電子工学専攻
-
尼崎 太樹
熊本大学大学院自然科学研究科
-
尼崎 太樹
熊本大学大学院自然科学研究科情報電気電子工学専攻
-
飯田 全広
三菱電機エンジニアリング(株)
-
末吉 敏則
熊本大学大学院自然科学研究科
-
飯田 全広
熊本大学大学院自然科学研究科
-
田浦 健
熊本大学大学院自然科学研究科
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